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    A 66-dB SNDR Pipelined Split-ADC in 40-nm CMOS Using a Class-AB Residue Amplifier
    Makinwa, Kofi A. A. ; Bult, Klaas ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-10-01), S. 2939-2950
    Online unknown
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    Linear, time-invariant model of the dynamics of a CMOS CC-CP
    Palma, Kenneth ; Moll, Francesc ; et al.
    2019
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    Design of an adjustable bias circuit using a single-sided CMOS supply for avalanche photodiodes
    Deng, Shijie ; Morrison, Alan P.
    In: 10th IEEE International NEWCAS Conference, 2012-06-01
    Online unknown
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    A 1.0-to-4.0GHz 65nm CMOS Four-Element Beamforming Receiver Using a Switched-Capacitor Vector Modulator with Approximate Sine Weighting via Charge Redistribution
    Frank E. van Vliet ; Eric A.M. Klumperink ; et al.
    2011
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    Continuous-time ?? modulators with improved linearity and reduced clock jitter sensitivity using the switched-capacitor return-to-zero DAC
    Nandi, T. ; Boominathan, K. ; et al.
    In: IndraStra Global, 2013
    Online unknown
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    A Low-Spur Fractional-N PLL Based on a Time-Mode Arithmetic Unit
    Gao, Zhong ; He, Jingchu ; et al.
    2023
    Online unknown
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    A compact programmable differential voltage reference with unbuffered 4 mA output current capability and ±0.4 % untrimmed spread
    Bruschi, Paolo ; Simmarano, Roberto ; et al.
    In: ESSCIRC 2017 - 43rd IEEE European Solid State Circuits Conference, 2017-09-01
    Online unknown
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    PSO-based charge pump chip area minimization
    Mnif, Hassene ; Loulou, Mourad ; et al.
    2012
    Online unknown
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    A Delta Sigma-Modulated Sample and Average Common-Mode Feedback Technique for Capacitively Coupled Amplifiers in a 192-nW Acoustic Analog Front-End
    Rothe, Rohit ; Cho, Minchang ; et al.
    Online unknown
    Zugriff:
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    Wie komme ich dran?
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