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    A Modular Analog Front-end for the Recording of Neural Spikes and Local Field Potentials within a Neural Measurement System.
    Heidmann, Nils ; Hellwege, Nico ; et al.
    In: Procedia Engineering, Jg. 87 (2014-12-18), S. 1239-1242
    Online academicJournal
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    A hybrid design approach of PVT tolerant, power efficient ring VCO.
    Maiti, Madhusudan ; Saw, Suraj Kumar ; et al.
    In: Ain Shams Engineering Journal, Jg. 11 (2020-06-01), Heft 2, S. 265-272
    Online academicJournal
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    A High Performance Bulk Driven Quasi Floating Gate MOSEFT Based Current Mirror.
    Rana, Charu ; Afzal, Neelofer ; et al.
    In: Procedia Computer Science, Jg. 79 (2016-02-01), S. 747-754
    Online academicJournal
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    Power-Aware Alternative Adder Cell Structure Using Swing Restored Complementary Pass Transistor Logic at 45nm Technology.
    Bhagyalaxmi, T. ; Rajendar, S. ; et al.
    In: Procedia Materials Science, Jg. 10 (2015-07-01), S. 789-792
    Online academicJournal
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    Quasi delay insensitive implementation of approximate multiplication.
    Balasubramanian, Padmanabhan ; Mastorakis, Nikos E.
    In: Ain Shams Engineering Journal, Jg. 13 (2022-05-01), Heft 3, S. N.PAG
    Online academicJournal
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    Schmitt Trigger based SRAM Cell for Ultralow Power Operation- A CNFET based Approach.
    Srinivasan, Vinesh ; Varshad Venkatraman, R. ; et al.
    In: Procedia Engineering, Jg. 64 (2013-10-01), S. 115-124
    Online academicJournal
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    A New Reduced Multiplication Structure for Low Power and Low Area Modified Booth Encoding Multiplier.
    Ravi, Nirlakalla ; Rao, T. Subba ; et al.
    In: Procedia Engineering, Jg. 38 (2012-09-01), S. 2767-2771
    Online academicJournal
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    A Novel 10-Transistor Encoder Design for Modified Booth Encoder to Optimize Power and Area.
    Ravi, Nirlakalla ; Rao, T. ; et al.
    In: Procedia Engineering, Jg. 38 (2012-09-01), S. 1858-1862
    Online academicJournal
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    A 10b 20MS/s Low Power Pipelined A/D Converter Without Dedicated SHA.
    HuanZhi, Dong ; YingQin, Zhang
    In: Physics Procedia, Jg. 33 (2012-09-01), S. 1366-1373
    Online academicJournal
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    Design of Control unit for Low Power AU Using Reversible Logic.
    Aradhya, H.V. Ravish ; Kumar, B.V. Praveen ; et al.
    In: Procedia Engineering, Jg. 30 (2012-05-29), S. 631-638
    Online academicJournal
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    Lower-power TSPC-based Domino Logic Circuit Design with 2/3 Clock Load.
    Tang, Fang ; Bermak, Amine
    In: Energy Procedia, Jg. 14 (2012-02-01), S. 1168-1174
    Online academicJournal
    Zugriff:
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