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    A 940 MHz data rate 8 Mb CMOS SRAM
    Braceras, G. ; Roberts, A. ; et al.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 198-199
    Konferenz
    Wie komme ich dran?
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    A 75 mW 10 b 20 MSample/s CMOS subranging ADC with 59 dB SNDR
    Brandt, B. ; Lutsky, J.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 322-323
    Konferenz
    Wie komme ich dran?
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    Low-power design of high-capacitive CMOS circuits using a new charge sharing scheme
    Khellah, M.M. ; Elmasry, M.I.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 286-287
    Konferenz
    Wie komme ich dran?
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    A 750 Mb/s 0.6 /spl mu/m CMOS two-phase input port using self-tested self-synchronization
    Mu, Fenghao ; Svensson, C.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 178-179
    Konferenz
    Wie komme ich dran?
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    A 3.3 V 90 MHz flash memory module embedded in a 32 b RISC microcontroller
    Hiraki, M. ; Tanaka, T. ; et al.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 116-117
    Konferenz
    Wie komme ich dran?
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    A 0.2 /spl mu/m 1.8 V SOI 550 MHz 64 b PowerPC microprocesser with copper interconnects
    Allen, D.H. ; Aipperspach, A.G. ; et al.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 438-439
    Konferenz
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    A 500 MHz 1.5 MB cache with on-chip CPU
    Lachman, J. ; Hill, J.M.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 192-193
    Konferenz
    Wie komme ich dran?
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    A sub-40 ns random-access chain FRAM architecture with a 768 cell-plate-line drive
    Takashima, D. ; Shuto, S. ; et al.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 102-103
    Konferenz
    Wie komme ich dran?
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    A 2.5 GFLOPS 6.5 million polygons per second 4-way VLIW geometry processor with SIMD instructions and a software bypass mechanism
    Higaki, N. ; Kubosawa, H. ; et al.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 260-261
    Konferenz
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  10. Detailansicht für Treffer 10 öffnen
    Flip-flop selection technique for power-delay trade-off [video codec]
    Hamada, M. ; Terazawa, T. ; et al.
    In: 1999 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC. First Edition (Cat. No.99CH36278), 1999, S. 270-271
    Konferenz
    Wie komme ich dran?
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