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    Ultra-Lightweight 548–1080 Gate 166Gbps/W–12.6Tbps/W SIMON 32/64 Cipher Accelerators for IoT in 14nm Tri-gate CMOS
    Kaul, Himanshu ; Anders, Mark ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 1-4
    Konferenz
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    A Power and Area Efficient 2.5-16 Gbps Gen4 PCIe PHY in 10nm FinFET CMOS
    Li, Shenggao ; Spagna, Fulvio ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 5-8
    Konferenz
    Wie komme ich dran?
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    A Sub-Picosecond Hybrid DLL for Large-Scale Phased Array Synchronization
    Gal-Katziri, Matan ; Hajimiri, Ali
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 231-234
    Konferenz
    Wie komme ich dran?
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    A 2.1 pJ/bit, 8 Gb/s Ultra-Low Power In-Package Serial Link Featuring a Time-based Front-end and a Digital Equalizer
    Chiu, Po-Wei ; Liu, Muqing ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 187-190
    Konferenz
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    A Fast Auto-Frequency Calibration Technique for Wideband PLL with Wide Reference Frequency Range
    Zhang, Zhao ; Yang, Jincheng ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 227-230
    Konferenz
    Wie komme ich dran?
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    A bulk 65nm Cortex-M0+ SoC with All-Digital Forward Body Bias for 4.3X Subthreshold Speedup
    Prabhat, Pranay ; Knight, Graham ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 183-186
    Konferenz
    Wie komme ich dran?
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    A 10-Gb/s, 0.03-mm2, 1.28-pJ/bit Half-Rate All-Digital Injection-Locked Clock and Data Recovery with Maximum Timing-Margin Tracking Loop
    Choo, Min-Seong ; Ko, Han-Gon ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 73-76
    Konferenz
    Wie komme ich dran?
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    A 2× Blind Oversampling FSE Receiver with Combined Adaptive Equalization and Infinite-Range Timing Recovery
    Son, Seuk ; Yeo, Hwanseok ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 201-204
    Konferenz
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    A Bimodal (NRZ/PAM-4) ISI Tolerant Timing Recovery with Adaptive DDJ Equalization
    Hossain, Masum ; Aurangozeb ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 205-208
    Konferenz
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    A 38-mW 7-bit 5-GS/s Time-Interleaved SAR ADC with Background Skew Calibration
    Chung, Yung-Hui ; Hu, Chia-Yi ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 243-246
    Konferenz
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  11. Detailansicht für Treffer 11 öffnen
    A 0.46V-1.1V Transition-Detector with In-Situ Timing-Error Detection and Correction Based on Pulsed-Latch Design in AES Accelerator
    Shang, Xinchao ; Shan, Weiwei ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 1-4
    Konferenz
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  12. Detailansicht für Treffer 12 öffnen
    A 6.8 TOPS/W Energy Efficiency, 1.5µW Power Consumption, Pulse Width Modulation Neuromorphic Circuits for Near-Data Computing with SSD
    Tsurumi, Kota ; Suzuki, Kenta ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 129-132
    Konferenz
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    An Enhanced Built-off-Test Transceiver with Wide-range, Self-calibration Engine for 3.2 Gb/s/pin DDR4 SDRAM
    Moon, Joung-Wook ; Yoo, Hye-Sung ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 139-142
    Konferenz
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    A 7b 2 GS/s Time-Interleaved SAR ADC with Time Skew Calibration Based on Current Integrating Sampler
    Jiang, Wenning ; Zhu, Yan ; et al.
    In: 2018 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2018-11-01, S. 235-238
    Konferenz
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