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    A 28 nm CMOS low-noise amplifier with novel redundant noise cancellation technique beyond ultra-wideband for 6G-based wireless systems.
    Jatoth, Deepak Naik ; Gorre, Pradeep ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 174 (2024-01-15), S. N.PAG
    Online academicJournal
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    A 28-GHz eight-element phased-array receiver front-end with compact size in 65-nm CMOS technology for 5G new radio.
    Tahbazalli, Parsa
    In: AEU: International Journal of Electronics & Communications, Jg. 170 (2023-10-01), S. N.PAG
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    A 39-GHz down-conversion mixer with a compact and broadband transformer-based image-rejection filter in 65-nm CMOS.
    Duan, Haipeng ; Wang, Yiyang ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 178 (2024-05-01), S. N.PAG
    Online academicJournal
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    An 8-way series-parallel combiner based power amplifier for mm-wave 5G communication in 40-nm CMOS.
    Zhao, Dongyan ; Wang, Hang ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 177 (2024-04-01), S. N.PAG
    Online academicJournal
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    A 18–33 GHz CMOS LNA with 26.7 dB peak gain and 2.8 dB minimum NF for K/Ka-band applications.
    Luo, Jiang ; Shen, Yi ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 177 (2024-04-01), S. N.PAG
    Online academicJournal
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    An energy-efficient hybrid CMOS spiking neuron circuit design with a memristive based novel T-type artificial synapse.
    Nalliboyina, Keerthi ; Ramachandran, Sakthivel
    In: AEU: International Journal of Electronics & Communications, Jg. 173 (2024), S. N.PAG
    Online academicJournal
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    An 8 bit-ENOB Sampling-rate Reconfigurable Asynchronous SAR ADC with Metastability Watchdog Circuit for Activity-driven Multi-Channel CMOS Readout ASICs for Space Applications.
    Karim, Rashid ; Grassi, Marco ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 173 (2024), S. N.PAG
    Online academicJournal
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    A 5.7–6.0 GHz CMOS PLL with low phase noise and −68 dBc reference spur.
    Li, Xiaoqiang ; Zhang, Jingwei ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 85 (2018-02-15), S. 23-31
    Online academicJournal
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    K-band CMOS voltage-controlled oscillator using tail current modulation with half-output frequency.
    Son, Hyeon Jin ; Choi, Ui-Gyu ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 175 (2024-02-01), S. N.PAG
    Online academicJournal
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    A high performance CMOS voltage reference in one simple circuit.
    Chen, Qibin ; Xie, Jin ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 173 (2024), S. N.PAG
    Online academicJournal
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    CMOS substrate RC netlist reduction towards design cycle speed up.
    Karipidis, S. ; Noulis, T.
    In: AEU: International Journal of Electronics & Communications, Jg. 171 (2023-11-01), S. N.PAG
    Online academicJournal
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    A 10-bit 33.3-kS/s 3.2-fJ/conversion-step single-ended counter-type SAR ADC with dual 5-bit CDAC arrays and counters in 65-nm CMOS.
    Tehranian, Armin ; Peiravi, Ali
    In: AEU: International Journal of Electronics & Communications, Jg. 175 (2024-02-01), S. N.PAG
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    A compact four quadrant CMOS analog multiplier.
    Rocha-Perez, Jose Miguel ; Zamora-Mejia, Gregorio ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 108 (2019-08-01), S. 53-61
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    An enhanced fast slew rate recycling folded cascode Op-Amp with general improvement in 180 nm CMOS process.
    Feizbakhsh, Seyed Vahid ; Yosefi, Ghader
    In: AEU: International Journal of Electronics & Communications, Jg. 101 (2019-03-01), S. 200-217
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    A compact modular CMOS WLED driver for multi-display applications.
    Abuishmais, Ibrahim ; Ahmad, Hani H. ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 173 (2024), S. N.PAG
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    Design and analysis of PVT tolerant hybrid current starved ring VCO with bulk driven keeper technique at 45 nm CMOS technology for the PLL application.
    Sivasakthi, M. ; Radhika, P.
    In: AEU: International Journal of Electronics & Communications, Jg. 173 (2024), S. N.PAG
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    Design method for a reconfigurable CMOS LNA with input tuning and active balun.
    Akbar, Fatemeh ; Atarodi, Mojtaba ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 69 (2015), Heft 1, S. 424-431
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    Ultra-low-power CMOS voltage references: Analysis and optimization regarding technology node.
    Olivera, Fabián ; Petraglia, Antonio
    In: AEU: International Journal of Electronics & Communications, Jg. 164 (2023-05-15), S. N.PAG
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    CMRR-bandwidth extension technique for CMOS differential amplifiers.
    Ben-Esmael, M. ; Hart, B. L. ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 68 (2014-10-01), Heft 10, S. 990-993
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    A 28 GHz four-channel phased-array transceiver in 65-nm CMOS technology for 5G applications.
    Ameen, Hesham A. ; Abdelmonem, Kareem ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 98 (2019), S. 19-28
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