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    Sensing CPU Voltage Noise Through Electromagnetic Emanations
    Hadjilambrou, Z. ; Das, S. ; et al.
    In: IEEE Computer Architecture Letters, Jg. 17 (2018), S. 68-71
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    Statistical Analysis of Multicore CPUs Operation in Scaled Voltage Conditions
    Papadimitriou, George ; Gizopoulos, Dimitris ; et al.
    In: IEEE Computer Architecture Letters, Jg. 17 (2018-07-01), S. 109-112
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    HeteroSim: A Heterogeneous CPU-FPGA Simulator
    Feng, Liang ; Sinha, Sharad ; et al.
    In: IEEE Computer Architecture Letters, Jg. 16 (2017), S. 38-41
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    A Scalable HW-Based Inline Deduplication for SSD Arrays
    Kim, Joonsung ; Kim, Jangwoo ; et al.
    In: IEEE Computer Architecture Letters, Jg. 17 (2018), S. 47-50
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    Exploring Core and Cache Hierarchy Bottlenecks in Graph Processing Workloads
    Li, Shuangchen ; Xie, Yuan ; et al.
    In: IEEE Computer Architecture Letters, Jg. 17 (2018-07-01), S. 197-200
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    Energy Aware Persistence: Reducing the Energy Overheads of Persistent Memory
    Kannan, Sudarsun ; Qureshi, Moinudin ; et al.
    In: IEEE Computer Architecture Letters, Jg. 15 (2016-07-01), S. 89-92
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    KSM: Online Application-Level Performance Slowdown Prediction for Spatial Multitasking GPGPU
    Zhao, Wenyi ; Guo, Minyi ; et al.
    In: IEEE Computer Architecture Letters, Jg. 17 (2018-07-01), S. 187-191
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    Worklist-Directed Prefetching
    Ma, Xiaoyu ; Zhang, Dan ; et al.
    In: IEEE Computer Architecture Letters, Jg. 16 (2017-07-01), S. 170-173
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    Covert Channels on GPGPUs
    Naghibijouybari, Hoda ; Abu-Ghazaleh, Nael
    In: IEEE Computer Architecture Letters, Jg. 16 (2017), S. 22-25
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    Thermally Adaptive Cache Access Mechanisms for 3D Many-Core Architectures
    Xiao, He ; Yalamanchili, Sudhakar ; et al.
    In: IEEE Computer Architecture Letters, Jg. 15 (2016-07-01), S. 129-132
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    ReDRAM: A Reconfigurable DRAM Cache for GPGPUs
    Mutyam, Madhu ; Sahoo, Debiprasanna ; et al.
    In: IEEE Computer Architecture Letters, Jg. 17 (2018-07-01), S. 213-216
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  12. Detailansicht für Treffer 12 öffnen
    HMC-MAC: Processing-in Memory Architecture for Multiply-Accumulate Operations with Hybrid Memory Cube
    Chung, Ki-Seok ; Jeon, Dong-Ik ; et al.
    In: IEEE Computer Architecture Letters, Jg. 17 (2018), S. 5-8
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    IMEC: A Fully Morphable In-Memory Computing Fabric Enabled by Resistive Crossbar
    Li, Jing ; Zha, Yue
    In: IEEE Computer Architecture Letters, Jg. 16 (2017-07-01), S. 123-126
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    Optimizing Read-Once Data Flow in Big-Data Applications
    Kolodny, Avinoam ; Erez, Mattan ; et al.
    In: IEEE Computer Architecture Letters, Jg. 16 (2017), S. 68-71
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    Diversity: A Design Goal for Heterogeneous Processors
    Tomusk, E. ; Dubach, C. ; et al.
    In: IEEE Computer Architecture Letters, Jg. 15 (2016-07-01), S. 81-84
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