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    Ising-CIM: A Reconfigurable and Scalable Compute Within Memory Analog Ising Accelerator for Solving Combinatorial Optimization Problems.
    Xie, Shanshan ; Raman, Siddhartha Raman Sundara ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-11-01), Heft 11, S. 3453-3465
    Online academicJournal
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    CIM-Spin: A Scalable CMOS Annealing Processor With Digital In-Memory Spin Operators and Register Spins for Combinatorial Optimization Problems.
    Su, Yuqi ; Kim, Hyunjoon ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-07-01), Heft 7, S. 2263-2273
    Online academicJournal
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    ±CIM SRAM for Signed In-Memory Broad-Purpose Computing From DSP to Neural Processing.
    Jain, Saurabh ; Lin, Longyang ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-10-01), Heft 10, S. 2981-2992
    Online academicJournal
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    Volltext
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    STICKER-IM: A 65 nm Computing-in-Memory NN Processor Using Block-Wise Sparsity Optimization and Inter/Intra-Macro Data Reuse.
    Yue, Jinshan ; Liu, Yongpan ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-08-01), Heft 8, S. 2560-2573
    Online academicJournal
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    A 65-nm 8T SRAM Compute-in-Memory Macro With Column ADCs for Processing Neural Networks.
    Yu, Chengshuo ; Yoo, Taegeun ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-11-01), Heft 11, S. 3466-3476
    Online academicJournal
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    Two-Way Transpose Multibit 6T SRAM Computing-in-Memory Macro for Inference-Training AI Edge Chips.
    Su, Jian-Wei ; Si, Xin ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-02-01), Heft 2, S. 609-624
    Online academicJournal
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    A 40-nm, 64-Kb, 56.67 TOPS/W Voltage-Sensing Computing-In-Memory/Digital RRAM Macro Supporting Iterative Write With Verification and Online Read-Disturb Detection.
    Yoon, Jong-Hyeok ; Chang, Muya ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022), Heft 1, S. 68-79
    Online academicJournal
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    TIMAQ: A Time-Domain Computing-in-Memory-Based Processor Using Predictable Decomposed Convolution for Arbitrary Quantized DNNs.
    Yang, Jianxun ; Kong, Yuyao ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-10-01), Heft 10, S. 3021-3038
    Online academicJournal
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    Colonnade: A Reconfigurable SRAM-Based Digital Bit-Serial Compute-In-Memory Macro for Processing Neural Networks.
    Kim, Hyunjoon ; Yoo, Taegeun ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-07-01), Heft 7, S. 2221-2233
    Online academicJournal
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    A 4-Kb 1-to-8-bit Configurable 6T SRAM-Based Computation-in-Memory Unit-Macro for CNN-Based AI Edge Processors.
    Chiu, Yen-Cheng ; Zhang, Zhixiao ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-10-01), Heft 10, S. 2790-2801
    Online academicJournal
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    A Twin-8T SRAM Computation-in-Memory Unit-Macro for Multibit CNN-Based AI Edge Processors.
    Si, Xin ; Liu, Rui ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020), Heft 1, S. 189-202
    Online academicJournal
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    Embedded 1-Mb ReRAM-Based Computing-in- Memory Macro With Multibit Input and Weight for CNN-Based AI Edge Processors.
    Xue, Cheng-Xin ; Chang, Ting-Wei ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020), Heft 1, S. 203-215
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    An Embedded nand Flash-Based Compute-In-Memory Array Demonstrated in a Standard Logic Process.
    Kim, Minsu ; Liu, Muqing ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-02-01), Heft 2, S. 625-638
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    A 40-nm MLC-RRAM Compute-in-Memory Macro With Sparsity Control, On-Chip Write-Verify, and Temperature-Independent ADC References.
    Li, Wantong ; Sun, Xiaoyu ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-09-01), Heft 9, S. 2868-2877
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  15. Detailansicht für Treffer 15 öffnen
    A 65 nm Wireless Image SoC Supporting On-Chip DNN Optimization and Real-Time Computation-Communication Trade-Off via Actor-Critical Neuro-Controller.
    Cao, Ningyuan ; Chatterjee, Baibhab ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-08-01), Heft 8, S. 2545-2559
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    A Local Computing Cell and 6T SRAM-Based Computing-in-Memory Macro With 8-b MAC Operation for Edge AI Chips.
    Si, Xin ; Tu, Yung-Ning ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-09-01), Heft 9, S. 2817-2831
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    A Rel-12 2G/3G/LTE-Advanced 2CC Transmitter.
    Mohammadi, Behnam ; Kahrizi, Masoud ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-05-01), Heft 5, S. 1080-1095
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    Implementation of a Fourth-Generation 1.8-GHz Dual-Core SPARC V9 Microprocessor.
    Hart, Jason M. ; Lee, Kyung T. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006), Heft 1, S. 210-217
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    A Large-Scale and Low-Power CAM Architecture Featuring a One-Hot-Spot Block Code for IP-Address Lookup in a Network Router.
    Hanzawa, Satoru ; Sakata, Takeshi ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 40 (2005-04-01), Heft 4, S. 853-861
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    On-Die Droop Detector for Analog Sensing of Power Supply Noise.
    Muhtaroglu, Ali ; Taylor, Greg ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 39 (2004-04-01), Heft 4, S. 651-660
    Online academicJournal
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