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    Electrostatic Discharge Protection Design for High-Voltage Programming Pin in Fully-Silicided CMOS ICs
    Ker, Ming-Dou ; Shieh, Wuu-Trong ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011-02-01), S. 537-545
    Online unknown
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    Design of Charge Pump Circuit With Consideration of Gate-Oxide Reliability in Low-Voltage CMOS Processes
    Tsai, Chia-Shen ; Ker, Ming-Dou ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006-05-01), S. 1100-1107
    Online unknown
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    ESD protection for CMOS output buffer by using modified LVTSCR devices with high trigger current
    Ker, Ming-Dou
    In: IEEE Journal of Solid-State Circuits, Jg. 32 (1997), S. 1293-1296
    Online unknown
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  4. Detailansicht für Treffer 4 öffnen
    Capacitor-Less Design of Power-Rail ESD Clamp Circuit With Adjustable Holding Voltage for On-Chip ESD Protection
    Ker, Ming-Dou ; Yeh, Chih-Ting
    In: IEEE Journal of Solid-State Circuits, 2010-11-01
    Online unknown
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  5. Detailansicht für Treffer 5 öffnen
    A new on-chip ESD protection circuit with dual parasitic SCR structures for CMOS VLSI
    Lee, Chung-Yuan ; Wu, Chung-Yu ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 27 (1992-03-01), S. 274-280
    Online unknown
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sm 576 - 768
md 768 - 992
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