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    A VHF Wide-Input Range CMOS Passive Rectifier With Active Bias Tuning
    Lu, Yan ; Martins, Rui P. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-10-01), S. 2629-2638
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    A 230–260-GHz Wideband and High-Gain Amplifier in 65-nm CMOS Based on Dual-Peak $G_{{\mathrm{max}}}$ -Core
    Lee, Sang-Gug ; Bao Huu Lam ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-06-01), S. 1613-1623
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    A 290-mV, 3.34-MHz, 6T SRAM With pMOS Access Transistors and Boosted Wordline in 65-nm CMOS Technology
    Sachdev, Manoj ; Nabavi, Morteza
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-02-01), S. 656-667
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    A 5.6 ppm/°C Temperature Coefficient, 87-dB PSRR, Sub-1-V Voltage Reference in 65-nm CMOS Exploiting the Zero-Temperature-Coefficient Point
    Chang, Joseph S. ; Jiang, Jize ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-03-01), S. 623-633
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    Short Channel Output Conductance Enhancement Through Forward Body Biasing to Realize a 0.5 V 250 0.6–4.2 GHz Current-Reuse CMOS LNA
    El-Gamal, Mourad N. ; Allidina, Karim ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-03-01), S. 574-586
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    350 mV, 5 GHz Class-D Enhanced Swing Differential and Quadrature VCOs in 65 nm CMOS
    Fiez, Terri S. ; Mayaram, Kartikeya ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-08-01), S. 1833-1847
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    A 0.5-V 5.2-fJ/Conversion-Step Full Asynchronous SAR ADC With Leakage Power Reduction Down to 650 pW by Boosted Self-Power Gating in 40-nm CMOS
    Ishikuro, Hiroki ; Sekimoto, Ryota ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-11-01), S. 2628-2636
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    A Push–Pull Class-C CMOS VCO
    Mazzanti, Andrea ; Andreani, Pietro
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-03-01), S. 724-732
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    On-Chip Combined C-V/I-V Characterization System in 45-nm CMOS Technology
    Realov, Simeon ; Shepard, Kenneth L.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-03-01), S. 814-826
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    A 12-Bit 3 GS/s Pipeline ADC With 0.4 mm$^{2}$ and 500 mW in 40 nm Digital CMOS
    Hung, Juo-Jung ; Liu, Wenbo ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-04-01), S. 1013-1021
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    A 0.41 µA Standby Leakage 32 kb Embedded SRAM with Low-Voltage Resume-Standby Utilizing All Digital Current Comparator in 28 nm HKMG CMOS
    Maeda, Noriaki ; Morimoto, Masao ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-04-01), S. 917-923
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    Subthreshold, Varactor-Driven CMOS Floating-Gate Current Memory Array With Less Than 150-ppm/$^{\circ}$K Temperature Sensitivity
    Chakrabartty, Shantanu ; Gu, Ming
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-11-01), S. 2846-2856
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    High-Efficiency Differential-Drive CMOS Rectifier for UHF RFIDs
    Sasaki, A. ; Ito, Takashi ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 44 (2009-11-01), S. 3011-3018
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    A Sub-600-mV, Fluctuation Tolerant 65-nm CMOS SRAM Array With Dynamic Cell Biasing
    Kowalczyk, Steven P. ; Ziegler, Matthew M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 43 (2008-04-01), S. 946-955
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    A 0.18-$\mu{\hbox {m}}$ CMOS Balanced Amplifier for 24-GHz Applications
    Hsu, Shawn S. H. ; Jin, Jun-De
    In: IEEE Journal of Solid-State Circuits, Jg. 43 (2008), S. 440-445
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    A High-Speed Low-Power Multi-VDD CMOS/SIMOX SRAM With LV-TTL Level Input/Output Pins—Write/Read Assist Techniques for 1-V Operated Memory Cells
    Shibata, Nobutaro ; Watanabe, Mayumi ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010-09-01), S. 1856-1869
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    An ultra-low-energy multi-standard JPEG co-processor in 65 nm CMOS with sub/near threshold supply voltage
    Ha, Yajun ; Pu, Yu ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010), Heft 3, S. 668-680
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    A 31.3-dBm Bulk CMOS T/R Switch Using Stacked Transistors With Sub-Design-Rule Channel Length in Floated p-Wells
    Kenneth, K. O. ; Xu, Haifeng
    In: IEEE Journal of Solid-State Circuits, Jg. 42 (2007-11-01), S. 2528-2534
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    A Complementary Switched MOSFET Architecture for the 1/f Noise Reduction in Linear Analog CMOS ICs
    Koh, Jeongwook ; Thewes, Roland ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 42 (2007-06-01), S. 1352-1361
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    Implementation of Initial-On ESD Protection Concept With PMOS-Triggered SCR Devices in Deep-Submicron CMOS Technology
    Chen, Shih-Hung ; Ker, Ming-Dou
    In: IEEE Journal of Solid-State Circuits, Jg. 42 (2007-05-01), S. 1158-1168
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