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    A Low-Latency and High-Endurance MLC STT-MRAM-Based Cache System.
    Wei Zhao 0034 ; Jie Xu 0013 ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 42 (2023), Heft 1, S. 122-135
    academicJournal
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    Alternative Encoding: A Two-Step Transition Reduction Scheme for MLC STT-RAM Cache.
    Hsieh, Jen-Wei ; Hou, Yueh-Ting ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 41 (2022), Heft 8, S. 2753-2757
    academicJournal
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    Data Representation Aware of Damage to Extend the Lifetime of MLC NAND Flash Memory.
    Zhou, Bin ; Ye, Ting ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 41 (2022), Heft 11, S. 5005-5015
    academicJournal
    Wie komme ich dran?
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    Multiple Subpage Writing FTL in MLC by Exploiting Dual Mode Operations.
    Feng, Yazhi ; Dan Feng 0001 ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 39 (2020), Heft 3, S. 599-612
    academicJournal
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    Pattern-Aware Encoding for MLC PCM Storage Density, Energy Efficiency, and Performance Enhancement.
    Kwon, Taehyun ; Muhammad Imran 0010 ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 39 (2020), Heft 9, S. 1855-1865
    academicJournal
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    Bit-Flipping Schemes Upon MLC Flash: Investigation, Implementation, and Evaluation.
    Wenhui Zhang 0005 ; Qiang Cao 0001 ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 38 (2019), Heft 4, S. 780-784
    academicJournal
    Wie komme ich dran?
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    Pair-Bit Errors Aware LDPC Decoding in MLC NAND Flash Memory.
    Meng Zhang 0014 ; Fei Wu 0005 ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 38 (2019), Heft 12, S. 2312-2320
    academicJournal
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    TriZone: A Design of MLC STT-RAM Cache for Combined Performance, Energy, and Reliability Optimizations.
    Liu, Zihao ; Mao, Mengjie ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 37 (2018), Heft 10, S. 1985-1998
    academicJournal
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    NVM-Based FPGA Block RAM With Adaptive SLC-MLC Conversion.
    Lei Ju 0001 ; Sui, Xiaojin ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 37 (2018), Heft 11, S. 2661-2672
    academicJournal
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    An Endurance-Aware Metadata Allocation Strategy for MLC NAND Flash Memory Storage Systems.
    Min Huang 0002 ; Liu, Zhaoqing ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 35 (2016), Heft 4, S. 691-694
    academicJournal
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    Adaptive Paired Page Prebackup Scheme for MLC NAND Flash Memory.
    Lee, Jaeil ; Shin, Dongkun
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 33 (2014), Heft 7, S. 1110-1114
    academicJournal
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    VAST: Virtually Associative Sector Translation for MLC Storage Systems.
    Hsieh, Jen-Wei ; Zheng, Yu-Cheng ; et al.
    In: IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., Jg. 32 (2013), Heft 8, S. 1137-1150
    academicJournal
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