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    Demonstration of Single-Flux-Quantum 64-B Lookup Table With Cryo-CMOS Decoders for Reconfiguration.
    Hironaka, Yuki ; Hosoya, Takuya ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 32 (2022-11-01), Heft 8, S. 1-5
    Online academicJournal
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    Volltext
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    Design and Implementation of a Single Flux Quantum Logic-Based Memory Controller for Josephson-CMOS Hybrid Memory Systems.
    Demirhan, Seda ; Bozbey, Ali
    In: IEEE Transactions on Applied Superconductivity, Jg. 30 (2020-10-01), Heft 7, S. 1-6
    Online academicJournal
    Zugriff:
    Volltext
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    Demonstration of a Single-Flux-Quantum Microprocessor Operating With Josephson-CMOS Hybrid Memory.
    Hironaka, Yuki ; Yamanashi, Yuki ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 30 (2020-10-01), Heft 7, S. 1-6
    Online academicJournal
    Zugriff:
    Volltext
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    Josephson-CMOS Hybrid Memory With Nanocryotrons.
    Tanaka, Masamitsu ; Suzuki, Masato ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 27 (2017-06-01), Heft 4, Part 1, S. 1-4
    Online academicJournal
    Zugriff:
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    Design and Demonstration of an Adiabatic-Quantum-Flux-Parametron Field-Programmable Gate Array Using Josephson-CMOS Hybrid Memories.
    Okuma, Yukihiro ; Takeuchi, Naoki ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 29 (2019-12-01), Heft 8, S. 1-6
    Online academicJournal
    Zugriff:
    Volltext
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    Fully Functional Operation of Low-Power 64-kb Josephson-CMOS Hybrid Memories.
    Konno, Gen ; Yamanashi, Yuki ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 27 (2017-06-01), Heft 4, Part 1, S. 1-7
    Online academicJournal
    Zugriff:
    Volltext
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    Logic Optimization, Complex Cell Design, and Retiming of Single Flux Quantum Circuits.
    Katam, Naveen Kumar ; Pedram, Massoud
    In: IEEE Transactions on Applied Superconductivity, Jg. 28 (2018-10-01), Heft 7, S. 1-9
    Online academicJournal
    Zugriff:
    Volltext
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    Characterization of 4 K CMOS Devices and Circuits for Hybrid Josephson-CMOS Systems.
    Yoshikawa, N. ; Tomida, T. ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 15 (2005-06-01), Heft 2, S. 267-271
    Online academicJournal
    Zugriff:
    Volltext
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    New Josephson-CMOS Interface Amplifier.
    Wei, Daniel ; Whiteley, Stephen R. ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 21 (2011-06-01), Heft 3, S. 805-808
    Online academicJournal
    Zugriff:
    Volltext
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  10. Detailansicht für Treffer 10 öffnen
    Optimization of hybrid JJ/CMOS memory operating temperatures.
    Gupta, D. ; Amrutur, B. ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 7 (1997-06-01), Heft 2, S. 3307-3310
    Online academicJournal
    Zugriff:
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    Simulation and Measurements on a 64-kbit Hybrid Josephson-CMOS Memory.
    Liu, Q. ; Van Duzer, T. ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 15 (2005-06-01), Heft 2, S. 415-418
    Online academicJournal
    Zugriff:
    Volltext
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  12. Detailansicht für Treffer 12 öffnen
    Latency and Power Measurements on a 64-kb Hybrid Josephson-CMOS Memory.
    Liu, Q. ; Fujiwara, K. ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 17 (2007-06-01), Heft 2, S. 526-529
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Scalable Matrix Multiplication With Hybrid CMOS-RSFQ Digital Signal Processor.
    Kataeva, Irma ; Engseth, Henrik ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 17 (2007-06-01), Heft 2, S. 486-489
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    Design of HTS Coplanar Waveguide Matching Circuit for Low Noise CMOS-HTS Receiver.
    Kanaya, H. ; Koga, Y. ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 13 (2003-06-01), Heft 2, S. 1031-1034
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Josephson-CMOS Hybrid Memory With Ultra-High-Speed Interface Circuit.
    Feng, Y.J. ; Meng, X. ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 13 (2003-06-01), Heft 2, S. 467-470
    Online academicJournal
    Zugriff:
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  16. Detailansicht für Treffer 16 öffnen
    Optimization of hybrid JJ/CMOS memory operating temperatures.
    Gupta, D. ; Amrutur, B.
    In: IEEE Transactions on Applied Superconductivity, Jg. 7 (1997-06-04), Heft 2, S. 3307-3310
    Online academicJournal
    Zugriff:
    Volltext
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  17. Detailansicht für Treffer 17 öffnen
    Component Development for a 16Gb/s RSFQ-CMOS Interface System.
    Yoshikawa, Nobuyuki ; Abe, Takashi ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 11 (2001-03-01), Heft 1, S. 735-738
    Online academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    Optimization of Suzuki Stack Circuit to Reduce Power Dissipation.
    Mustafa, Yerzhan ; Kose, Selcuk
    In: IEEE Transactions on Applied Superconductivity, Jg. 32 (2022-11-01), Heft 8, S. 1-7
    Online academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    An interface circuit for a Josephson-CMOS hybrid digital system.
    Suzuki, M. ; Maezawa, M.
    In: IEEE Transactions on Applied Superconductivity, Jg. 9 (1999-06-03), Heft 2, S. 3314-3317
    Online academicJournal
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  20. Detailansicht für Treffer 20 öffnen
    A Logic Verification Framework for SFQ and AQFP Superconducting Circuits.
    Fayyazi, Arash ; Munir, Mustafa ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 31 (2021-12-01), Heft 9, S. 1-11
    Online academicJournal
    Zugriff:
    Volltext
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