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    Ultra-Low Power CMOS Image Sensor With Two-Step Logical Shift Algorithm-Based Correlated Double Sampling Scheme.
    Park, Keunyeol ; Yeom, Seonwoo ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-11-01), Heft 11, S. 3718-3727
    Online serialPeriodical
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    Design of a 5.2-GHz CMOS Power Amplifier Using TF-Based 2-Stage Dual-Radial Power Splitting/Combining Architecture.
    Tsai, Jeng-Han
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 66 (2019-10-01), Heft 10, S. 3690-3699
    Online serialPeriodical
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    Design of a Wideband Variable-Gain Amplifier With Self-Compensated Transistor for Accurate dB-Linear Characteristic in 65 nm CMOS Technology.
    Kong, Lingshan ; Liu, Hang ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-12-01), Heft 12, S. 4187-4198
    Online serialPeriodical
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    Design of A Novel Highly EMI-Immune CMOS Miller OpAmp Considering Channel Length Modulation.
    Boyapati, Subrahmanyam ; Redoute, Jean-Michel ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017-10-01), Heft 10, S. 2679-2690
    Online serialPeriodical
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    Wideband 28-nm CMOS Variable-Gain Amplifier.
    Asgari, Vahid ; Belostotski, Leonid
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020), Heft 1, S. 37-47
    Online serialPeriodical
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    A 7-GHz CMOS Bidirectional Variable Gain Amplifier With Low Gain and Phase Imbalances.
    Suh, Bosung ; Kim, Doojung ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 65 (2018-09-01), Heft 9, S. 2669-2678
    Online serialPeriodical
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    An Area-Efficient Column-Parallel Digital Decimation Filter With Pre-BWI Topology for CMOS Image Sensor.
    Tang, Fang ; Wang, Zhongjie ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 65 (2018-08-01), Heft 8, S. 2524-2533
    Online serialPeriodical
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    94-GHz CMOS Power Amplifiers Using Miniature Dual Y-Shaped Combiner With RL Load.
    Lin, Yo-Sheng ; Nguyen, Van Kien
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017-06-01), Heft 6, S. 1285-1298
    Online serialPeriodical
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    A CMOS Pixel With Embedded ADC, Digital CDS and Gain Correction Capability for Massively Parallel Imaging Array.
    Klosowski, M. ; Jendernalik, W. ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017), Heft 1, S. 38-49
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  10. Detailansicht für Treffer 10 öffnen
    A 29.5 dBm Class-E Outphasing RF Power Amplifier With Efficiency and Output Power Enhancement Circuits in 45nm CMOS.
    Banerjee, Aritra ; Hezar, Rahmi ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017-08-01), Heft 8, S. 1977-1988
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    A High-Precision Resistor-Less CMOS Compensated Bandgap Reference Based on Successive Voltage-Step Compensation.
    Ming, Xin ; Hu, Li ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 65 (2018-12-01), Heft 12, S. 4086-4096
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    A Generalized Approach to Implement Efficient CMOS-Based Threshold Logic Functions.
    Mozaffari, Seyed Nima ; Tragoudas, Spyros ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 65 (2018-03-01), Heft 3, S. 946-959
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    Design Methodology of Subthreshold Three-Stage CMOS OTAs Suitable for Ultra-Low-Power Low-Area and High Driving Capability.
    Grasso, Alfio Dario ; Marano, Davide ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 62 (2015-06-01), Heft 6, S. 1453-1462
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    A 1.6-V Tolerant Multiplexer Switch With 0.96-V Core Devices in 28-nm CMOS Technology.
    Biccario, Giuseppe E. ; Vitrenko, Oleg ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 68 (2021-11-01), Heft 11, S. 4626-4635
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    A 90-GHz Asymmetrical Single-Pole Double-Throw Switch With >19.5-dBm 1-dB Compression Point in Transmission Mode Using 55-nm Bulk CMOS Technology.
    Chen, Lisheng ; Chen, Lang ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 68 (2021-11-01), Heft 11, S. 4616-4625
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    X-SRAM: Enabling In-Memory Boolean Computations in CMOS Static Random Access Memories.
    Agrawal, Amogh ; Jaiswal, Akhilesh ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 65 (2018-12-01), Heft 12, S. 4219-4232
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    Tunable CMOS Pseudo-Resistors for Resistances of Hundreds of GΩ.
    Rueda-Diaz, Jeffer Mauricio ; Bolzan, Evandro ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 69 (2022-02-01), Heft 2, S. 657-667
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    Analysis and Design of a 0.3-THz Signal Generator Using an Oscillator-Doubler Architecture in 40-nm CMOS.
    Guo, Kaizhe ; Chan, Chi Hou ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 69 (2022-06-01), Heft 6, S. 2284-2296
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    Overhead Requirements for Stateful Memristor Logic.
    Hu, Xuan ; Schultis, Michael J. ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 66 (2019), Heft 1, S. 263-273
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    Energy- and Area-Efficient CMOS Synapse and Neuron for Spiking Neural Networks With STDP Learning.
    Joo, Bomin ; Han, Jin-Woo ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 69 (2022-09-01), Heft 9, S. 3632-3642
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