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    A Linear Wideband CMOS Balun-LNA With Balanced Loads
    Yavari, Mohammad ; Shirmohammadi, Bahareh
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 69 (2022-03-01), S. 754-758
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    A 16b 120MS/s Pipelined ADC Using an Auxiliary-Capacitor-Based Calibration Technique Achieving 90.5dB SFDR in 0.18 μm CMOS
    Xu, Honglin ; Sun, Jie ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 69 (2022-03-01), S. 809-813
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    A Compact Single-Transistor Current Source for Analog Design in Nanometer Digital CMOS
    Heming, Zhao ; Donghai, Qiao ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-12-01), S. 3508-3512
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    A 1.7-to-2.7GHz 35–38% PAE Multiband CMOS Power Amplifier Employing a Digitally-Assisted Analog Pre-Distorter (DAAPD) Reconfigurable Linearization Technique
    Mak, Pui-In ; Rajendran, Jagadheswaran ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-11-01), S. 3381-3385
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    A 73dB-A Audio VCO-ADC Based on a Maximum Length Sequence Generator in 130nm CMOS
    Pedro Augusto Borrego Lambin Torres Amaral ; Wiesbauer, Andreas ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-10-01), S. 3194-3198
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    A 0.99-pJ/b 15-Gb/s Counter-Based Adaptive Equalizer Using Single Comparator in 28-nm CMOS
    Kwon, Youngwook ; Park, Hyunsu ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-10-01), S. 3189-3193
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    A High-Speed and Energy-Efficient Multi-Bit Cyclic ADC Using Single-Slope Quantizer for CMOS Image Sensors
    Jeong, Ji-Yong ; Kwon, Oh-Kyong ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-07-01), S. 2322-2326
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    Single-Chip CMOS Reconfigurable Dual-Band Tri-Mode High-Efficiency RF Amplifier Design
    Liu, Hao-Yu ; Cheng, Kwok-Keung M. ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-03-01), S. 868-872
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    Peak-SNR Analysis of CMOS TDCs for SPAD-Based TCSPC 3D Imaging Applications
    Anthony Chan Carusone ; Arvani, Foad
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-03-01), S. 893-897
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    An Adaptive Offset Cancellation Scheme and Shared-Summer Adaptive DFE for 0.068 pJ/b/dB 1.62-to-10 Gb/s Low-Power Receiver in 40 nm CMOS
    Jung, Woosong ; Park, Kwanseo ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-02-01), S. 622-626
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    Tutorial: Design of High-Speed Nano-Scale CMOS Mixed-Voltage Digital I/O Buffer With High Reliability to PVTL Variations
    Wang, Chua-Chin
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-02-01), S. 562-567
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    New Charge-Steering DFEs in 55-nm CMOS
    Berton, David ; Aouini, Sadok ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021), S. 231-235
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    An 8-Bit 2.1-mW 350-MS/s SAR ADC With 1.5 b/cycle Redundancy in 65-nm CMOS
    Zhao, Lei ; Ding, Ruixue ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 67 (2020-11-01), S. 2307-2311
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    A Robust Hardened Latch Featuring Tolerance to Double-Node-Upset in 28nm CMOS for Spaceborne Application
    Tahoori, Mehdi B. ; Tan, Chiyu ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 67 (2020-09-01), S. 1619-1623
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    An 11-bit 100-MS/s Pipelined-SAR ADC Reusing PVT-Stabilized Dynamic Comparator in 65-nm CMOS
    Liu, Shubin ; Chan, Chi-Hang ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 67 (2020-07-01), S. 1174-1178
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    A 40-nm CMOS 12b 120-MS/s Nonbinary SAR-Assisted SAR ADC With Double Clock-Rate Coarse Decision
    Roh, Yi-Ju ; Ryu, Seung-Tak ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 67 (2020-12-01), S. 2833-2837
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    A 12 Gb/s 1.59 mW/Gb/s Input-Data-Jitter-Tolerant Injection-Type CDR With Super-Harmonic Injection-Locking in 65-nm CMOS
    Kim, Yong-Hun ; Jung, Chongsoo ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 66 (2019-12-01), S. 1972-1976
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    A 12.1 fJ/Conv.-Step 12b 140 MS/s 28-nm CMOS Pipelined SAR ADC Based on Energy-Efficient Switching and Shared Ring Amplifier
    An, Tai-Ji ; Park, Jun-Sang ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 66 (2019-07-01), S. 1119-1123
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    A Wideband Low-Noise Variable-Gain Amplifier With a 3.4 dB NF and up to 45 dB Gain Tuning Range in 130-nm CMOS
    Baumgratz, Filipe D. ; Saavedra, Carlos E. ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 66 (2019-07-01), S. 1104-1108
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    A 0.2-1.3 ns Range Delay-Control Scheme for a 25 Gb/s Data-Receiver Using a Replica Delay-Line-Based Delay-Locked-Loop in 45-nm CMOS
    Ellinger, Frank ; Mohammad Mahdi Khafaji ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 67 (2020-05-01), S. 806-810
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