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    Design and Experimentation of Inductorless Low-Pass NGD Integrated Circuit in 180-nm CMOS Technology.
    Wan, Fayu ; Gu, Taochen ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 41 (2022-11-01), Heft 11, S. 4965-4974
    Online academicJournal
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    Gaussian Fitness Functions for Optimizing Analog CMOS Integrated Circuits.
    de Lima Moreto, Rodrigo Alves ; Thomaz, Carlos Eduardo ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 36 (2017-10-01), Heft 10, S. 1620-1632
    Online academicJournal
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    A General Time-Domain Method for Harmonic Distortion Estimation in CMOS Circuits.
    Baxevanakis, Dimitrios ; Sotiriadis, Paul P.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 40 (2021), Heft 1, S. 157-170
    Online academicJournal
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    New 3-D CMOS Fabric With Stacked Horizontal Nanowires.
    Macha, Naveen Kumar ; Iqbal, Md Arif ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 38 (2019-09-01), Heft 9, S. 1625-1634
    Online academicJournal
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    An In-Field Programmable Adaptive CMOS LNA for Intelligent IoT Sensor Node Applications.
    Shafiee, Maryam ; Ozev, Sule
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 41 (2022-02-01), Heft 2, S. 201-210
    Online academicJournal
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    An All-MOSFET Voltage Reference-Based PUF Featuring Low BER Sensitivity to VT Variations and 163 fJ/Bit in 180-nm CMOS.
    Gan, Peizhou ; Zhao, Xiaojin ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 40 (2021-06-01), Heft 6, S. 1172-1182
    Online academicJournal
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    An Efficient Two-Phase ILP-Based Algorithm for Precise CMOS RFIC Layout Generation.
    Tseng, Tsun-Ming ; Li, Bing ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 36 (2017-08-01), Heft 8, S. 1313-1326
    Online academicJournal
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    Design Methodology for TFT-Based Pseudo-CMOS Logic Array With Multilayer Interconnection Architecture and Optimization Algorithms.
    Zhao, Qinghang ; Sun, Wenyu ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 38 (2019-11-01), Heft 11, S. 2043-2057
    Online academicJournal
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    An Analog Neural Network Computing Engine Using CMOS-Compatible Charge-Trap-Transistor (CTT).
    Du, Yuan ; Du, Li ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 38 (2019-10-01), Heft 10, S. 1811-1819
    Online academicJournal
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    Synthesis of mm-Wave Wideband Receivers in 28-nm CMOS Technology for Automotive Radar Applications.
    Passos, Fabio ; Chanca, Miguel ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 39 (2020-12-01), Heft 12, S. 4375-4384
    Online academicJournal
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    Generating Single- and Double-Pattern Tests for Multiple CMOS Fault Models in One ATPG Run.
    Kung, Yi-Cheng ; Lee, Kuen-Jong ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 39 (2020-06-01), Heft 6, S. 1340-1345
    Online academicJournal
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    Characterizing VeSFET-Based ICs With CMOS-Oriented EDA Infrastructure.
    Qiu, Xiang ; Marek-Sadowska, Malgorzata ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 33 (2014-04-01), Heft 4, S. 495-506
    Online academicJournal
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    On the Generation of Waveform-Accurate Hazard and Charge-Sharing Aware Tests for Transistor Stuck-Off Faults in CMOS Logic Circuits.
    Burchard, Jan ; Erb, Dominik ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 37 (2018-10-01), Heft 10, S. 2152-2165
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    Transient Analysis of CMOS-Gate-Driven RLGC Interconnects Based on FDTD.
    Li, Xiao-Chun ; Mao, Jun-Fa ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 30 (2011-04-01), Heft 4, S. 574-583
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Modeling the Overshooting Effect for CMOS Inverter Delay Analysis in Nanometer Technologies. .
    Huang, Zhangcai ; Kurokawa, Atsushi ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 29 (2010-02-01), Heft 2, S. 250-260
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    A Compact RF CMOS Modeling for Accurate High-Frequency Noise Simulation in Sub-100-nm MOSFETs.
    Guo, Jyh-Chyurn ; Lin, Yi-Min
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 27 (2008-09-01), Heft 9, S. 1684-1688
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    Design of CMOS MEMS Based on Mechanical Resonators Using a RF Simulation Approach.
    Latorre, Laurent ; Veroulle, Vincent ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 23 (2004-06-01), Heft 6, S. 962-967
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    A Compact Memristor-CMOS Hybrid Look-Up-Table Design and Potential Application in FPGA.
    Guo, Yanwen ; Wang, Xiaoping ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 36 (2017-12-01), Heft 12, S. 2144-2148
    Online academicJournal
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    Noise-Rejection Model Based on Charge-Transfer Equation for Digital CMOS Circuits.
    Korshak, Alexander
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 23 (2004-10-01), Heft 10, S. 1460-1465
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    Design and Multicorner Optimization of the Energy-Delay Product of CMOS Flip–Flops Under the Negative Bias Temperature Instability Effect.
    Abrishami, Hamed ; Hatami, Safar ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits & Systems, Jg. 32 (2013-06-01), Heft 6, S. 869-881
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