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    Analog layout generator for CMOS circuits
    Yilmaz, Ender ; Dundar, Gunhan
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 28 (2009), Heft 1, S. 32-45
    Online academicJournal
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    The sizing rules method for CMOS and bipolar analog integrated circuit synthesis
    Massier, Tobias ; Graeb, Helmut ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 27 (2008-12-01), Heft 12, S. 2209-2222
    Online academicJournal
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    Volltext
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    Charge recycling in power-gated CMOS circuits
    Pakbaznia, Ehsan ; Fallah, Farzan ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 27 (2008-10-01), Heft 10, S. 1798-1811
    Online academicJournal
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    A compact RF CMOS modeling for accurate high-frequency noise simulation in sub-100-nm MOSFETs
    Guo, Jyh-Chyurn ; Lin, Yi-Min
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 27 (2008-09-01), Heft 9, S. 1684-1688
    Online academicJournal
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    Crosstalk analysis for a CMOS-gate-driven coupled interconnects
    Kaushik, Brajesh Kumar ; Sarkar, Sankar
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 27 (2008-06-01), Heft 6, S. 1150-1154
    Online academicJournal
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    A synthesis tool for CMOS RF low-noise amplifiers
    Tulunay, Gulin ; Balkir, Sina
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 27 (2008-05-01), Heft 5, S. 977-982
    Online academicJournal
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    Experimental characterization of CMOS interconnect open defects
    Arumi, Daniel ; Rodriguez-Montanes, Rosa ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 27 (2008), Heft 1, S. 123-136
    Online academicJournal
    Zugriff:
    Volltext
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    Generalized power-delay metrics in deep submicron CMOS design
    Sengupta, Dipanjan ; Saleh, Resve
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 26 (2007), Heft 1, S. 183-189
    Online academicJournal
    Zugriff:
    Volltext
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    Modeling and analysis of loading effect on leakage of nanoscaled bulk-CMOS logic circuits
    Mukhopadhyay, Saibal ; Bhunia, Swarup ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 25 (2006-08-01), Heft 8, S. 1486-1495
    Online academicJournal
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    Modeling of failure probability and statistical design of SRAM array for field enhancement in nanoscaled CMOS
    Mukhopadhyay, Saibal ; Mahmoodi, Hamid ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 24 (2005-12-01), Heft 12, S. 1859-1880
    Online academicJournal
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    Diagnosis of resistive-open and stuck-open defects in digital CMOS ICs
    James Chien-Mo Li ; McCluskey, Edward J
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 24 (2005-11-01), Heft 11, S. 1748-1759
    Online academicJournal
    Zugriff:
    Volltext
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    Delay analysis of CMOS gates using modified logical effort model
    Kabbani, A. ; Al-Khalili, D. ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 24 (2005-06-01), Heft 6, S. 937-947
    Online academicJournal
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    Symbolic failure analysis of complex CMOS circuits due to excessive leakage current and charge sharing
    Bahar, R. Iris ; Song, Hui-Yuan ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 24 (2005-04-01), Heft 4, S. 502-515
    Online academicJournal
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    Accurate estimation of total leakage in nanometer-scale bulk CMOS circuits based on device geometry and doping profile
    Mukhopadhyay, Saibal ; Raychowdhury, Arijit ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 24 (2005-03-01), Heft 3, S. 363-381
    Online academicJournal
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    Noise-rejection model based on charge-transfer equation for digital CMOS circuits
    Korshak, Alexander
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 23 (2004-10-01), Heft 10, S. 1460-1465
    Online academicJournal
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    Design of CMOS MEMS based on mechanical resonators using a RF simulation approach
    Latorre, Laurent ; Beroulle, Vincent ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 23 (2004-06-01), Heft 6, S. 962-967
    Online academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    SiSMA- a tool for efficient analysis of analog CMOS integrated circuits affected by device mismatch
    Biagetti, Giorgio ; Orcioni, Simone ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 23 (2004-02-01), Heft 2, S. 192-207
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    Design and optimization of multithreshold CMOS (MTCMOS) circuits
    Anis, Mohab ; Areibi, Shawki ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 22 (2003-10-01), Heft 10, S. 1324-1342
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    Technology-portable analytical model for DSM CMOS inverter transition-time estimation
    Kabbani, Adnan ; Khalili, Dhamin al ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 22 (2003-09-01), Heft 9, S. 1177-1187
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    A CAD methodology for optimizing transistor current and sizing in analog CMOS design
    Binkley, D.M. ; Hopper, C.E. ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 22 (2003-02-01), Heft 2, S. 225-236
    Online academicJournal
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