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    An All-MOSFET Voltage Reference-Based PUF Featuring Low BER Sensitivity to VT Variations and 163 fJ/Bit in 180-nm CMOS
    Cao, Yuan ; Gan, Peizhou ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 40 (2021-06-01), S. 1172-1182
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    A General Time-Domain Method for Harmonic Distortion Estimation in CMOS Circuits
    Baxevanakis, Dimitrios ; Sotiriadis, Paul P.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 40 (2021), S. 157-170
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    An Analog Neural Network Computing Engine Using CMOS-Compatible Charge-Trap-Transistor (CTT)
    Du, Yuan ; Chen, Xiaoliang ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 38 (2019-10-01), S. 1811-1819
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    New 3-D CMOS Fabric With Stacked Horizontal Nanowires
    Rahman, Mostafizur ; Iqbal, Arif ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 38 (2019-09-01), S. 1625-1634
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    Design Methodology for TFT-Based Pseudo-CMOS Logic Array With Multilayer Interconnection Architecture and Optimization Algorithms
    Sun, Wenyu ; Guo, Xiaojun ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 38 (2019-11-01), S. 2043-2057
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    On the Generation of Waveform-Accurate Hazard and Charge-Sharing Aware Tests for Transistor Stuck-Off Faults in CMOS Logic Circuits
    Singh, Adit D. ; Burchard, Jan ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 37 (2018-10-01), S. 2152-2165
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    A Compact Memristor-CMOS Hybrid Look-Up-Table Design and Potential Application in FPGA
    Wang, Xiaoping ; Guo, Yanwen ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 36 (2017-12-01), S. 2144-2148
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    An Efficient Two-Phase ILP-Based Algorithm for Precise CMOS RFIC Layout Generation
    Li, Bing ; Yeh, Ching-Feng ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 36 (2017-08-01), S. 1313-1326
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    Transition time modeling in deep submicron CMOS
    Rezzoug, M. ; Auvergne, Daniel ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 21 (2002-11-01), S. 1352-1363
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    Managing Test Coverage Uncertainty due to Random Noise in Nano-CMOS: A Case-Study on an SRAM Array
    Kundu, Sandip ; Suresh, Vikram B.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 35 (2016), S. 155-165
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    M2A2: Microscale Modular Assembled ASICs for High-Mix, Low-Volume, Heterogeneously Integrated Designs
    Sayal, Aseem ; Sreenivasan, Sidlgata V. ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 39 (2020-12-01), S. 4760-4776
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    A Macromodeling Approach for Analog Behavior of Digital Integrated Circuits
    Rohrer, Ron ; Mirzaie, Nahid
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 39 (2020-12-01), S. 5025-5031
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    Advance Interconnect Circuit Modeling Design Using Fractional-Order Elements
    Yakovlev, Alexander B. ; Al-Daloo, Mohammed ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 39 (2020-10-01), S. 2722-2734
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    Iterative Diagnosis Approach for ECC-Based Memory Repair
    Nicolaidis, Michael ; Papavramidou, Panagiota
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 39 (2020-02-01), S. 464-477
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    Monitoring Aging Defects in STT-MRAMs
    Sachdev, Manoj ; Yoon, Youngki ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 39 (2020-12-01), S. 4645-4656
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    An Algorithm for the Search of a Low Capacitor Count DAC Switching Scheme for SAR ADCs
    Pilipko, Mikhail M. ; Morozov, Dmitry
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 39 (2020-12-01), S. 5309-5313
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    IJTAG-Based Fault Recovery and Robust Microelectrode-Cell Design for MEDA Biochips
    Zhong, Zhanwei ; Chakrabarty, Krishnendu
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 39 (2020-12-01), S. 4921-4934
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    Adjusting Learning Rate of Memristor-Based Multilayer Neural Networks via Fuzzy Method
    Yang, Yin ; Zeng, Zhigang ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 38 (2019-06-01), S. 1084-1094
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    Extending the Lifetime of MEDA Biochips by Selective Sensing on Microelectrodes
    Zhong, Zhanwei ; Chakrabarty, Krishnendu ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 39 (2020-11-01), S. 3531-3543
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    Physically Aware Affinity-Driven Multiplier Implementation
    Maltabashi, Or ; Kra, Yehuda ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 39 (2020-10-01), S. 2886-2897
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