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    Innovative structures for CMOS combinational gates synthesis
    Sciuto, Donatella ; Stefanelli, Renato ; et al.
    In: IEEE Transactions on Computers, Jg. 43 (1994-04-01), S. 385-399
    Online unknown
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    View record in OpenAIRE (Volltext)
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    Power-Efficient Heterogeneous Many-Core Design With NCFET Technology.
    Salamin, Sami ; Rapp, Martin ; et al.
    In: IEEE Transactions on Computers, Jg. 70 (2021-09-01), Heft 9, S. 1484-1497
    Online academicJournal
    Zugriff:
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    Karnaugh Map Method for Memristive and Spintronic Asymmetric Basis Logic Functions.
    Vyas, Vaibhav ; Jiang-Wei, Lucian ; et al.
    In: IEEE Transactions on Computers, Jg. 70 (2021), Heft 1, S. 128-138
    Online academicJournal
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    Novel Methods for Efficient Realization of Logic Functions Using Switching Lattices.
    Aksoy, Levent ; Altun, Mustafa
    In: IEEE Transactions on Computers, Jg. 69 (2020-03-01), Heft 3, S. 427-440
    Online academicJournal
    Zugriff:
    Volltext
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    JBNN: A Hardware Design for Binarized Neural Networks Using Single-Flux-Quantum Circuits.
    Fu, Rongliang ; Huang, Junying ; et al.
    In: IEEE Transactions on Computers, Jg. 71 (2022-12-01), Heft 12, S. 3203-3214
    Online academicJournal
    Zugriff:
    Volltext
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    SOT-MRAM Digital PIM Architecture With Extended Parallelism in Matrix Multiplication.
    Kim, Taehwan ; Jang, Yunho ; et al.
    In: IEEE Transactions on Computers, Jg. 71 (2022-11-01), Heft 11, S. 2816-2828
    Online academicJournal
    Zugriff:
    Volltext
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    A Ferroelectric-Based Volatile/Non-Volatile Dual-Mode Buffer Memory for Deep Neural Network Accelerators.
    Luo, Yandong ; Luo, Yuan-Chun ; et al.
    In: IEEE Transactions on Computers, Jg. 71 (2022-09-01), Heft 9, S. 2088-2101
    Online academicJournal
    Zugriff:
    Volltext
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    PEAF: A Power-Efficient Architecture for SRAM-Based FPGAs Using Reconfigurable Hard Logic Design in Dark Silicon Era.
    Ebrahimi, Zahra ; Khaleghi, Behnam ; et al.
    In: IEEE Transactions on Computers, Jg. 66 (2017-06-01), Heft 6, S. 982-995
    Online academicJournal
    Zugriff:
    Volltext
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    New Low-Area Designs for the AES Forward, Inverse and Combined S-Boxes.
    Reyhani-Masoleh, Arash ; Taha, Mostafa ; et al.
    In: IEEE Transactions on Computers, Jg. 69 (2020-12-01), Heft 12, S. 1757-1773
    Online academicJournal
    Zugriff:
    Volltext
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  10. Detailansicht für Treffer 10 öffnen
    New Multiplicative Inverse Architectures Using Gaussian Normal Basis.
    Reyhani-Masoleh, Arash ; El-Razouk, Hayssam ; et al.
    In: IEEE Transactions on Computers, Jg. 68 (2019-07-01), Heft 7, S. 991-1006
    Online academicJournal
    Zugriff:
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    QCA Systolic Array Design.
    Lu, Liang ; Liu, Weiqiang ; et al.
    In: IEEE Transactions on Computers, Jg. 62 (2013-03-01), Heft 3, S. 548-560
    Online academicJournal
    Zugriff:
    Volltext
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  12. Detailansicht für Treffer 12 öffnen
    Design of Approximate Radix-4 Booth Multipliers for Error-Tolerant Computing.
    Liu, Weiqiang ; Qian, Liangyu ; et al.
    In: IEEE Transactions on Computers, Jg. 66 (2017-08-01), Heft 8, S. 1435-1441
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Identifying the Worst Reliability Input Vectors and the Associated Critical Logic Gates.
    Ibrahim, Walid
    In: IEEE Transactions on Computers, Jg. 65 (2016-06-01), Heft 6, S. 1748-1760
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    3D Integration of CMOL Structures for FPGA Applications.
    Abid, Zine ; Liu, Ming ; et al.
    In: IEEE Transactions on Computers, Jg. 60 (2011-04-01), Heft 4, S. 463-463
    Online academicJournal
    Zugriff:
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  15. Detailansicht für Treffer 15 öffnen
    Accurate and Efficient Estimation of Logic Circuits Reliability Bounds.
    Ibrahim, Walid ; Shousha, Marwa ; et al.
    In: IEEE Transactions on Computers, Jg. 64 (2015-05-01), Heft 5, S. 1217-1229
    Online academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    A Stochastic Computational Approach for Accurate and Efficient Reliability Evaluation.
    Han, Jie ; Chen, Hao ; et al.
    In: IEEE Transactions on Computers, Jg. 63 (2014-06-01), Heft 6, S. 1336-1350
    Online academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    Fast Inversion in \schmiGF(2^m) with Normal Basis Using Hybrid-Double Multipliers.
    Azarderakhsh, Reza ; Jarvinen, Kimmo ; et al.
    In: IEEE Transactions on Computers, Jg. 63 (2014-04-01), Heft 4, S. 1041-1047
    Online academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    Efficient and High-Performance Parallel Hardware Architectures for the AES-GCM.
    Mozaffari-Kermani, Mehran ; Reyhani-Masoleh, Arash
    In: IEEE Transactions on Computers, Jg. 61 (2012-08-01), Heft 8, S. 1165-1165
    Online academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    A Pattern Generation Technique for Maximizing Switching Supply Currents Considering Gate Delays.
    Ganeshpure, Kunal ; Sanyal, Alodeep ; et al.
    In: IEEE Transactions on Computers, Jg. 61 (2012-07-01), Heft 7, S. 986-986
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  20. Detailansicht für Treffer 20 öffnen
    New Low-Area Designs for the AES Forward, Inverse and Combined S-boxes
    Reyhani-Masoleh, A. (Arash) ; Taha, M. (Mostafa) ; et al.
    In: IEEE Transactions on Computers, 2019
    academicJournal
    Wie komme ich dran?
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