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    Physics-Based and Closed-Form Model for Cryo-CMOS Subthreshold Swing.
    Beckers, Arnout ; Michl, Jakob ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 22 (2023-07-01), S. 590-596
    Online academicJournal
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    Hybrid CMOS-PCM Ternary Logic for Digital Circuit Applications.
    Kumar, Manoj ; Suri, Manan
    In: IEEE Transactions on Nanotechnology, Jg. 22 (2023-07-01), S. 228-237
    Online academicJournal
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    Carbon Nanotube CMOS Analog Circuitry.
    Ho, Rebecca ; Lau, Christian ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 18 (2018-12-01), Heft 1, S. 845-848
    Online academicJournal
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    A Highly Parallel and Energy Efficient Three-Dimensional Multilayer CMOS-RRAM Accelerator for Tensorized Neural Network.
    Huang, Hantao ; Ni, Leibin ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 17 (2018-07-01), Heft 4, S. 645-656
    Online academicJournal
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    Design and Simulation of a 128 kb Embedded Nonvolatile Memory Based on a Hybrid RRAM (HfO2 )/28 nm FDSOI CMOS Technology.
    Portal, Jean-Michel ; Bocquet, Marc ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 16 (2017-07-01), Heft 4, S. 677-686
    Online academicJournal
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    Three-Dimensional Nano-Acoustic Bragg Reflectors for CMOS Embedded NEMS.
    Yandrapalli, Soumya ; Ruffieux, David ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 16 (2017-07-01), Heft 4, S. 653-658
    Online academicJournal
    Zugriff:
    Volltext
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    Skybridge-3D-CMOS: A Fine-Grained 3D CMOS Integrated Circuit Technology.
    Li, Mingyu ; Shi, Jiajun ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 16 (2017-07-01), Heft 4, S. 639-652
    Online academicJournal
    Zugriff:
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    On the Design and Analysis of Reliable RRAM-CMOS Hybrid Circuits.
    Garcia-Redondo, Fernando ; Lopez-Vallejo, Marisa
    In: IEEE Transactions on Nanotechnology, Jg. 16 (2017-05-01), Heft 3, S. 514-522
    Online academicJournal
    Zugriff:
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    Variability-Aware Analysis of Hybrid MTJ/CMOS Circuits by a Micromagnetic-Based Simulation Framework.
    De Rose, Raffaele ; Lanuzza, Marco ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 16 (2017-03-01), Heft 2, S. 160-168
    Online academicJournal
    Zugriff:
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  10. Detailansicht für Treffer 10 öffnen
    Nanostructural Analysis of CMOS-MEMS-Based Digital Microphone for Performance Optimization.
    Khan, Mansoor Ali ; Zheng, Rongkun
    In: IEEE Transactions on Nanotechnology, Jg. 15 (2016-11-01), Heft 6, S. 849-855
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    Majority-Based Spin-CMOS Primitives for Approximate Computing.
    Angizi, Shaahin ; Jiang, Honglan ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 17 (2018-07-01), Heft 4, S. 795-806
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    A New Device-Parameter-Oriented DC Power Model for Symmetric Operation of Junctionless Double-Gate mosfet Working on Low-Power CMOS Subthreshold Logic Gates.
    Gao, Hong-Wun ; Wang, Yeong-Her ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 17 (2018-05-01), Heft 3, S. 424-431
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    On-Chip Sparse Learning Acceleration With CMOS and Resistive Synaptic Devices.
    Seo, Jae-sun ; Lin, Binbin ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 14 (2015-11-01), Heft 6, S. 969-979
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    Investigation on High-Performance CMOS With p-Ge and n-InGaAs MOSFETs for Logic Applications.
    Tewari, Suchismita ; Biswas, Abhijit ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 14 (2015-03-01), Heft 2, S. 275-281
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Heterogeneous NEMS-CMOS DCM Buck Regulator for Improved Area and Enhanced Power Efficiency.
    Manohar, Sujan K. ; Venkatasubramanian, Ramakrishnan ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 14 (2015), Heft 1, S. 140-151
    Online academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    Localized Growth of Carbon Nanotubes on CMOS Substrate at Room Temperature Using Maskless Post-CMOS Processing.
    Zhou, Ying ; Johnson, Jason Lee ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 11 (2012), Heft 1, S. 16-20
    Online academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    Novel Design Methodology Using L\bf EXT Sizing in Nanowire CMOS Logic.
    Kaushal, G. ; Manhas, S. K. ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 13 (2014-07-01), Heft 4, S. 650-658
    Online academicJournal
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    Charge-Resistance Approach to Benchmarking Performance of Beyond-CMOS Information Processing Devices.
    Sarkar, Angik ; Nikonov, Dmitri E. ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 13 (2014), Heft 1, S. 143-150
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    Programmable CMOS/Memristor Threshold Logic.
    Gao, Ligang ; Alibart, Fabien ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 12 (2013-03-01), Heft 2, S. 115-119
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    Two-Phase RTD-CMOS Pipelined Circuits.
    Núñez, Juan ; Avedillo, María J. ; et al.
    In: IEEE Transactions on Nanotechnology, Jg. 11 (2012-12-01), Heft 6, S. 1063-1066
    Online academicJournal
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