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    A New Pathway Toward Implementing a Fully Integrated Band-Switchable CMOS Power Amplifier Utilizing Bit Optimized Reconfigurable Network (BORN).
    Hamidi, Seyyed Babak ; Dawn, Debasis
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-09-01), Heft 9, S. 1294-1305
    Online academicJournal
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    Design of a 5.3-GHz 31.3-dBm Fully Integrated CMOS Power Amplifier Using Folded Splitting and Combining Architecture.
    Tsai, Jeng-Han
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-07-01), Heft 7, S. 1527-1536
    Online academicJournal
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    Volltext
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    A Reconfigurable CMOS Rectifier With 14-dB Power Dynamic Range Achieving >36-dB/mm 2 FoM for RF-Based Hybrid Energy Harvesting.
    Choo, Alexander ; Ramiah, Harikrishnan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-10-01), Heft 10, S. 1533-1537
    Online academicJournal
    Zugriff:
    Volltext
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    Power-On Reset Circuit in 180-nm CMOS With Brownout Detection, Stable Switching Points, Long Reset Pulse Duration, and Resilience to Switching Noise.
    Antonov, Andrei A. ; Karpovich, Maksim S. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-10-01), Heft 10, S. 1373-1380
    Online academicJournal
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    Volltext
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  5. Detailansicht für Treffer 5 öffnen
    ADIC: Anomaly Detection Integrated Circuit in 65-nm CMOS Utilizing Approximate Computing.
    Kar, Bapi ; Gopalakrishnan, Pradeep Kumar ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-12-01), Heft 12, S. 2518-2529
    Online academicJournal
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    Volltext
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  6. Detailansicht für Treffer 6 öffnen
    CMOS First-Order All-Pass Filter With 2-Hz Pole Frequency.
    Paul, Anindita ; Ramirez-Angulo, Jaime ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-02-01), Heft 2, S. 294-303
    Online academicJournal
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    Volltext
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  7. Detailansicht für Treffer 7 öffnen
    A Comprehensive Time-Dependent Dielectric Breakdown Lifetime Simulator for Both Traditional CMOS and FinFET Technology.
    Yang, Kexin ; Liu, Taizhi ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-11-01), Heft 11, S. 2470-2482
    Online academicJournal
    Zugriff:
    Volltext
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  8. Detailansicht für Treffer 8 öffnen
    A 0.5-V Multiple-Input Bulk-Driven OTA in 0.18-μm CMOS.
    Khateb, Fabian ; Kulej, Tomasz ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-11-01), Heft 11, S. 1739-1747
    Online academicJournal
    Zugriff:
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  9. Detailansicht für Treffer 9 öffnen
    A Statistical Design Approach for a Digitally Programmable Mismatch-Tolerant High-Speed Nauta Structure Differential OTA in 65-nm CMOS.
    Nicholson, Andrew Peter ; Iberzanov, Artemij ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-09-01), Heft 9, S. 2899-2910
    Online academicJournal
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    Volltext
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  10. Detailansicht für Treffer 10 öffnen
    A Fully Integrated 10-V Pulse Driver Using Multiband Pulse-Frequency Modulation in 65-nm CMOS.
    Wu, Jiangchao ; Leong, Hou-Man ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-09-01), Heft 9, S. 1665-1669
    Online academicJournal
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    Volltext
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  11. Detailansicht für Treffer 11 öffnen
    A 24- \mu \textW 12-bit 1-MS/s SAR ADC With Two-Step Decision DAC Switching in 110-nm CMOS.
    Chung, Yung-Hui ; Yen, Chia-Wei ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-11-01), Heft 11, S. 3334-3344
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    A 0.0067-mm 2 12-bit 20-MS/s SAR ADC Using Digital Place-and-Route Tools in 40-nm CMOS.
    Tsai, Yao-Hung ; Liu, Shen-Iuan
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-07-01), Heft 7, S. 905-914
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    A Time-Efficient CMOS-Memristive Programmable Circuit Realizing Logic Functions in Generalized AND–XOR Structures.
    Aljafar, Muayad J. ; Perkowski, Marek A. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018), Heft 1, S. 23-36
    Online academicJournal
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    Dual C- and S-Band CMOS VCO Using the Shunt Varactor Switch.
    Jang, Sheng-Lyang ; Jain, Sanjeev
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 23 (2015-09-01), Heft 9, S. 1808-1813
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    A Ku-Band Eight-Element Phased-Array Transmitter With Built-in Self-Test Capability in 180-nm CMOS Technology.
    Yu, Yiming ; Chen, Dong ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-06-01), Heft 6, S. 694-705
    Online academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    A 12–14.5-GHz 10.2-mW −249-dB FoM Fractional- N Subsampling PLL With a High-Linearity Phase Interpolator in 40-nm CMOS.
    Chen, Yan-Ting ; Peng, Pen-Jui ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-05-01), Heft 5, S. 634-643
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    A 35-GHz TX and RX Front End With High TX Output Power for Ka-Band FMCW Phased-Array Radar Transceivers in CMOS Technology.
    Deng, Wei ; Wu, Rui ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-10-01), Heft 10, S. 2089-2098
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    Dual Use of Power Lines for Design-for-Testability—A CMOS Receiver Design.
    Salem, Jebreel M. ; Ha, Dong Sam
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-03-01), Heft 3, S. 1118-1125
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    All-Digital CMOS Time-to-Digital Converter With Temperature-Measuring Capability.
    Chen, Chun-Chi ; Chen, Chao-Lieh ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-09-01), Heft 9, S. 2079-2083
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  20. Detailansicht für Treffer 20 öffnen
    All-Digital Cost-Efficient CMOS Digital-to-Time Converter Using Binary-Weighted Pulse Expansion.
    Chen, Chun-Chi ; Hwang, Chorng-Sii ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-04-01), Heft 4, S. 1094-1098
    Online academicJournal
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