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    2.4-GHz 10-Mb/s BFSK Embedded Transmitter With a Stacked-LC DCO for Wireless Testing Systems
    LEE, Chi-Ying ; HSIEH, Chih-Cheng ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 9, S. 1727-1737
    Online academicJournal
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    Process-Resilient Low-Jitter All-Digital PLL via Smooth Code-Jumping
    CHAO, Pei-Ying ; TZENG, Chao-Wen ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 12, S. 2240-2249
    Online academicJournal
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    A Low-Jitter ADPLL via a Suppressive Digital Filter and an Interpolation-Based Locking Scheme
    HSU, Hsuan-Jung ; HUANG, Shi-Yu
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 1, S. 165-170
    Online academicJournal
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    A Low-Power and Portable Spread Spectrum Clock Generator for SoC Applications
    DUO, SHENG ; CHUNG, Ching-Che ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 6, S. 1112-1117
    Online academicJournal
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    A Compact Clock Generator for Heterogeneous GALS MPSoCs in 65-nm CMOS Technology
    HOPPNER, Sebastian ; EISENREICH, Holger ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 3, S. 566-570
    Online academicJournal
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    Glitch-Free NAND-Based Digitally Controlled Delay-Lines
    DE CARO, Davide ; MEMBER, Senior
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 1, S. 55-66
    Online academicJournal
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    A Low Voltage All-Digital On-Chip Oscillator Using Relative Reference Modeling
    YU, Chien-Ying ; YU, Jui-Yuan ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 9, S. 1615-1620
    Online academicJournal
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    A Fast Locking All-Digital Phase-Locked Loop via Feed-Forward Compensation Technique
    XIN, CHEN ; JUN, YANG ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 5, S. 857-868
    Online academicJournal
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    A Full Digital Fractional- $N$ TAF-FLL for Digital Applications: Demonstration of the Principle of a Frequency-Locked Loop Built on Time-Average-Frequency.
    Xiu, Liming ; Wei, Xiangye ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-03-01), Heft 3, S. 524-534
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    A Low-Jitter Fast-Locked All-Digital Phase-Locked Loop With Phase–Frequency-Error Compensation.
    Ho, Yung-Hsiang ; Yao, Chia-Yu
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-05-01), Heft 5, S. 1984-1992
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    A Low-Jitter Cell-Based Digitally Controlled Oscillator With Differential Multiphase Outputs.
    Su, Ming-Chiuan ; Jou, Shyh-Jye ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 23 (2015-04-01), Heft 4, S. 766-770
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