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    Sizing of the CMOS 6T‐SRAM cell for NBTI ageing mitigation
    Chenouf, Amel ; Bentarzi, Hamid ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-04-30), S. 555-561
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    1.2 V 10‐bits 40 MS/s CMOS SAR ADC for low‐power applications
    Lu, Chi-Chang ; Huang, Ding-Ke
    In: IET Circuits, Devices & Systems, Jg. 13 (2019-08-30), S. 857-862
    Online unknown
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    Fully‐differential flipped‐source‐follower low‐pass analogue filter in CMOS 28 nm bulk
    Mangiagalli, L. ; Marcello De Matteis ; et al.
    In: IET Circuits, Devices & Systems, Jg. 12 (2018-10-29), S. 689-695
    Online unknown
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    0.5 V bulk ‐ driven CMOS fully differential current feedback operational amplifier
    Khateb, Fabian ; Kumngern, Montree ; et al.
    In: IET Circuits, Devices & Systems, Jg. 13 (2019-03-18), S. 314-320
    Online unknown
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    Novel CMOS MO‐CFDITA based fully electronically controlled square/triangular wave generator with adjustable duty cycle
    Chaturvedi, Bhartendu ; Kumar, Atul
    In: IET Circuits, Devices & Systems, Jg. 12 (2018-10-16), S. 817-826
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    Low‐power 10‐bit 100 MS/s pipelined ADC in digital CMOS technology
    Rawat, Veena ; Agarwal, Alpana ; et al.
    In: IET Circuits, Devices & Systems, Jg. 11 (2017-09-21), S. 589-596
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    Resilience and yield of flip‐flops in future CMOS technologies under process variations and aging
    Backs, Benedikt ; Schmitt-Landsiedel, Doris ; et al.
    In: IET Circuits, Devices & Systems, Jg. 8 (2014), S. 19-26
    Online unknown
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    1.1‐V, 8‐bit, 12 MS/s asynchronous reference‐free successive‐approximation‐register analogue‐to‐digital converter in 0.18 μm CMOS with separated capacitor arrays
    Huang, Guanzhong ; Lin, Pingfen
    In: IET Circuits, Devices & Systems, Jg. 7 (2013), S. 1-8
    Online unknown
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    A 1.5 GHz phase-locked loop with leakage current suppression in 65 nm CMOS
    Chang, Jung-Yu ; Liu, Shen-Iuan
    In: IET Circuits, Devices & Systems, Jg. 3 (2009-12-01), S. 350-358
    Online unknown
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    Volltext (PDF)
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    CMOS multiplier based on the relationship between drain current and inversion charge
    Machado, M. B. ; Galup-Montoro, Carlos ; et al.
    In: IET Circuits, Devices & Systems, Jg. 3 (2009-10-01), S. 239-247
    Online unknown
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    Volltext (PDF)
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    Highly linear CMOS triode transconductor for VHF applications
    Jendernalik, Waldemar ; Szczepanski, Stanislaw ; et al.
    In: IET Circuits, Devices & Systems, Jg. 6 (2012), S. 9-9
    Online unknown
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    1.2-V, 10-bit, 60–360 MS/s time-interleaved pipelined analog-to-digital converter in 0.18 [micro sign]m CMOS with minimised supply headroom
    Sin, Sai-Weng ; Martins, Rui P. ; et al.
    In: IET Circuits, Devices & Systems, Jg. 4 (2010), S. 1-1
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    Switched positive/negative charge pump design using standard CMOS transistors
    Al-Bakheet, M.B. ; Mohammad, M.Gh. ; et al.
    In: IET Circuits, Devices & Systems, Jg. 4 (2010), S. 57-57
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    Noise‐power‐area optimised design procedure for OTAs with complementary input transistors for neural amplifiers
    Maryam Shojaei Baghini ; Devarshi Mrinal Das ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-07-20), S. 702-706
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  15. Detailansicht für Treffer 15 öffnen
    Approach for low power high speed 4‐bit flash analogue to digital converter
    Setoudeh, Farbod ; Mohammad Bagher Tavakoli ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-06-15), S. 425-431
    Online unknown
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  16. Detailansicht für Treffer 16 öffnen
    Systematic circuit design and analysis using generalised g m / I D functions of MOS devices
    Aminzadeh, Hamed
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-04-01), S. 432-443
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  17. Detailansicht für Treffer 17 öffnen
    Modelling for triple gate spin‐FET and design of triple gate spin‐FET‐based binary adder
    Farooq Ahmad Khanday ; Kharadi, Mubashir A. ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-03-20), S. 464-470
    Online unknown
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    Floating memristor and inverse memristor emulation configurations with electronic/resistance controllability
    Srivastava, Mayank ; Bhardwaj, Kapil
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-10-01), S. 1065-1076
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    1.8 V, 25.9 nW, 91.86 dB dynamic range second‐order lowpass filter tunable in the range 4–100 Hz
    Jayaram Reddy Machha Krishna Reddy ; Laxminidhi, Tonse
    In: IET Circuits, Devices & Systems, Jg. 13 (2019-10-01), S. 1086-1092
    Online unknown
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    Optimal designs of nulling resistor compensation and a robust bias‐based op‐amp circuit using an evolutionary approach
    Kanchan Baran Maj ; Kar, Rajib ; et al.
    In: IET Circuits, Devices & Systems, Jg. 13 (2019-07-19), S. 667-678
    Online unknown
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