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    A study of crosstalk through bonding and package parasitics in CMOS mixed analog-digital circuits
    TRUCCO, Gabriella ; BOSELLI, Giorgio ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 138-147
    Konferenz
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    Logic-level fast current simulation for digital CMOS circuits
    RUIZ DE CLAVIJO, Paulino ; JUAN-CHICO, Jorge ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 425-435
    Konferenz
    Wie komme ich dran?
  3. Detailansicht für Treffer 3 öffnen
    An activity monitor for power/performance tuning of CMOS digital circuits
    RIUS, Josep ; PINEDA, José ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 187-196
    Konferenz
    Wie komme ich dran?
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    A 260ps quasi-static ALU in 90nm CMOS
    PESSOLANO, F ; MEIJER, R. I. M. P
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 372-380
    Konferenz
    Wie komme ich dran?
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    Power dissipation reduction during synthesis of two-level logic based on probability of input vectors changes
    BRZOZOWSKI, Ireneusz ; KOS, Andrzej
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 456-465
    Konferenz
    Wie komme ich dran?
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    Leakage and dynamic glitch power minimization using integer linear programming for Vth assignment and path balancing
    YUANLIN, LU ; AGRAWAL, Vishwani D
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 217-226
    Konferenz
    Wie komme ich dran?
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    Design of variable input delay gates for low dynamic power circuits
    RAJA, Tezaswi ; AGRAWAL, Vishwani D ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 436-445
    Konferenz
    Wie komme ich dran?
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    Investigation of low-power low-voltage circuit techniques for a hybrid full-adder cell
    HASSOUNE, Ilham ; NEVE, Amaury ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 189-197
    Konferenz
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    A dual low power and crosstalk immune encoding scheme for system-on-chip buses
    KHAN, Zahid ; ARSLAN, Tughrul ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 585-592
    Konferenz
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  10. Detailansicht für Treffer 10 öffnen
    Power-clock gating in adiabatic logic circuits
    TEICHMANN, Philip ; FISCHER, Jurgen ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 638-646
    Konferenz
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  11. Detailansicht für Treffer 11 öffnen
    Two level compact simulation methodology for timing analysis of power-switched circuits
    HENZLER, Stephan ; GEORGAKOS, Georg ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 789-798
    Konferenz
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    Power supply net for adiabatic circuits
    FISCHER, Jürgen ; AMIRANTE, Ettore ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 413-422
    Konferenz
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  13. Detailansicht für Treffer 13 öffnen
    Power estimation for Ripple-Carry adders with correlated input data
    JOHANSSON, Kenny ; GUSTAFSSON, Oscar ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 662-674
    Konferenz
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    Design of a power/performance efficient single-loop sigma-delta modulator for wireless receivers
    RUSU, Ana ; BORODENKOV, Alexei ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 564-573
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    Delay evaluation of high speed data-path circuits based on threshold Logic
    CELINSKI, Peter ; ABBOTT, Derek ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 899-906
    Konferenz
    Wie komme ich dran?
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    A novel mechanism for delay-insensitive data transfer based on current-mode multiple valued logic
    OH, Myeong-Hoon ; HAR, Dong-Soo
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 691-700
    Konferenz
    Wie komme ich dran?
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    A fully digital numerical-controlled-oscillator
    ABDOLLAHI, S. R ; BAKKALOGLU, B ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2003, S. 389-398
    Konferenz
    Wie komme ich dran?
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