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    Monolithic 3D neuromorphic computing system with hybrid CMOS and memristor-based synapses and neurons
    Zhou, Zhen ; Shen, Fangyang ; et al.
    In: Integration, Jg. 65 (2019-03-01), S. 273-281
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    Post-process die-level electromagnetic field analysis on microwave CMOS low-noise amplifier for first-pass silicon fabrication success
    Norlaili Mohd Noh ; Eshghabadi, Farshad ; et al.
    In: Integration, Jg. 52 (2016), S. 217-227
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    Design and analysis of a 32 nm PVT tolerant CMOS SRAM cell for low leakage and high stability
    Lin, Sheng ; Lombardi, Fabrizio ; et al.
    In: Integration, Jg. 43 (2010-04-01), S. 176-187
    Online unknown
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    Waveform analysis and delay prediction for a CMOS gate driving RLC interconnect load
    Sarkar, S. ; Agarwal, R.P. ; et al.
    In: Integration, Jg. 40 (2007-07-01), S. 394-405
    Online unknown
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    2.0 V Bipolar/CMOS differential logic methodology for iterative network implementation
    Simion, Viorica
    In: Integration, Jg. 16 (1993-12-01), S. 163-177
    Online unknown
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    Transistor sizing for large combinational digital CMOS circuits
    Heusler, Lucas S. ; Fichtner, Wolfgang
    In: Integration, Jg. 10 (1991), S. 155-168
    Online unknown
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    Combinational static CMOS networks
    Yoeli, Michael ; Brzozowski, Janusz A.
    In: Integration, Jg. 5 (1987-06-01), S. 103-122
    Online unknown
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    An automatic cell pattern generation system for CMOS transistor-pair array LSI
    Miyashita, Hiroshi ; Ueda, Kazuhiro ; et al.
    In: Integration, Jg. 4 (1986-06-01), S. 115-133
    Online unknown
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    Introduction of a new technique for simultaneous reduction of the delay and leakage current in digital circuits
    Horri, Ashkan ; Mohammadian, Hamed ; et al.
    In: Integration, Jg. 78 (2021-05-01), S. 84-94
    Online unknown
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    Electronically tunable third-order dual-mode quadrature sinusoidal oscillators employing VDCCs and all grounded components
    Radha Raman Pal ; Roy, Suvajit
    In: Integration, Jg. 76 (2021), S. 99-112
    Online unknown
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    A novel area efficient on-chip RO-Sensor for recycled IC detection
    Sauvagya Ranjan Sahoo ; Mahapatra, Kamalakanta
    In: Integration, Jg. 70 (2020), S. 138-150
    Online unknown
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  12. Detailansicht für Treffer 12 öffnen
    Design methodology for full custom CMOS microcomputers
    Piguet, C.
    In: Integration, Jg. 1 (1983-12-01), S. 335-350
    Online unknown
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    A novel switchable pin method for regulating power in chip-multiprocessor
    Peng, Lu ; Zhao, Zhou ; et al.
    In: Integration, Jg. 58 (2017-06-01), S. 329-338
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  14. Detailansicht für Treffer 14 öffnen
    Efficient parasitic-aware hybrid sizing methodology for analog and RF integrated circuits
    Zhang, Lihong ; Liao, Tuotian
    In: Integration, Jg. 62 (2018-06-01), S. 301-313
    Online unknown
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  15. Detailansicht für Treffer 15 öffnen
    A novel spatially configurable differential interface for an electronic system prototyping platform
    Savaria, Yvon ; Blaquiere, Yves ; et al.
    In: Integration, Jg. 55 (2016-09-01), S. 129-137
    Online unknown
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  16. Detailansicht für Treffer 16 öffnen
    Temperature variation aware multi-scale delay, power and thermal analysis at RT and gate level
    Sadri, Mohammadsadegh ; Bartolini, Andrea ; et al.
    In: Integration, Jg. 49 (2015-03-01), S. 35-48
    Online unknown
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  17. Detailansicht für Treffer 17 öffnen
    Delay caused by resistive opens in interconnecting lines
    Rodriguez-Montanes, R. ; Figueras, Joan ; et al.
    In: Integration, Jg. 42 (2009-06-01), S. 286-293
    Online unknown
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  18. Detailansicht für Treffer 18 öffnen
    High-speed full adder based on minority function and bridge style for nanoscale
    Mohammad Hossein Moaiyeri ; Navi, Keivan ; et al.
    In: Integration, Jg. 44 (2011-06-01), S. 155-162
    Online unknown
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  19. Detailansicht für Treffer 19 öffnen
    IDDQ testing: state of the art and future trends
    Isern, Eugeni ; Ferré, A. ; et al.
    In: Integration, Jg. 26 (1998-12-01), S. 167-196
    Online unknown
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  20. Detailansicht für Treffer 20 öffnen
    Power and electromagnetic analysis: Improved model, consequences and comparisons
    Quisquater, Jean-Jacques ; Peeters, E. ; et al.
    In: Integration, Jg. 40 (2007), S. 52-60
    Online unknown
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