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    Design Analysis and Comparative Study of RF Receiver Front-Ends in 0.18-μm CMOS.
    Sumathi, M. ; Malarvizhi, S.
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 5 (2012), Heft 1, S. 7-19
    Online academicJournal
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    Volltext (PDF)
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    CDTA-Based Schmitt Trigger Using MT-CMOS Technique.
    Nadia, Jandeep ; Kumar, Ramnish
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 10 (2017-07-01), Heft 3, S. 7-14
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    A Study on CMOS Noise and Noise Reduction Techniques.
    Anilesh
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 10 (2017), Heft 1, S. 49-68
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    4-Bit Ripple Carry Adder Using Area-Efficient Full Adder in CMOS Technology.
    Kumar, Gyanender ; Hadda, Lincoln
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 14 (2021), Heft 1, S. 41-52
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    A Low Noise 16-Bit CMOS Digitally Controlled Oscillator.
    Kumar, Nitin ; Kumar, Manoj
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 5 (2012-07-01), Heft 3, S. 14-22
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    Design of Zero Skew Clock Tree for CMOS Image Sensor.
    Kansal, Shubhi
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 6 (2013-10-01), Heft 4, S. 7-12
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    Low-Voltage and Wide-Temperature Range Voltage Reference.
    Agarwal, Gopal ; Dwivedi, Ved Vyas
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 12 (2019-10-01), Heft 4, S. 20-27
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    An Energy-Efficient Full Adder Design Based on Energy Recovery Gates and Multiplexer Architecture.
    Kumar, Manoj ; Arya, Sandeep K. ; et al.
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 4 (2011), Heft 1, S. 21-30
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    Optimization and Synthesis of Combinational Circuits Using Improved mGDI Technique.
    Devi, Monika ; Duhan, Manoj
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 10 (2017), Heft 1, S. 18-26
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    An Analysis of Power and Stability of 6T SRAM Using Power Gating Technique.
    Kumar, Swati S. ; Gour, Sonam ; et al.
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 8 (2015-04-01), Heft 2, S. 35-41
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    New Third-Order Quadrature Sinusoidal Oscillator Employing Current Differencing Buffered Amplifiers.
    Komal ; Kumar, Ramnish ; et al.
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 15 (2022-10-01), Heft 4, S. 21-42
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    Design of Low Power 5-2 Compressor for Arithmetic Applications.
    Kumar, Sanjeev ; Kumar, Manoj
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 7 (2014), Heft 1, S. 33-40
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    High Performance Double Edge Triggered D Flip-Flop Based Shift Registers Using CNTFET.
    Ravi, T. ; Kannan, V.
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 7 (2014), Heft 1, S. 19-32
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    Performance Analysis of CNTFET on T Flip-Flop.
    Saravanan, V. ; Kannan, V.
    In: IUP Journal of Electrical & Electronics Engineering, Jg. 5 (2012-07-01), Heft 3, S. 57-66
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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