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    An isolated SNM model for high-stability multi-port register file in 65 nm CMOS
    Zhang, Yuejun ; Li, Gang ; et al.
    In: Journal of Semiconductors, Jg. 38 (2017-09-01), S. 095002-95002
    Online unknown
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    A 10-bit 110 MHz SAR ADC with asynchronous trimming in 65-nm CMOS
    Li, Xi ; Pu, Jie ; et al.
    In: Journal of Semiconductors, Jg. 38 (2017-04-01), S. 045003-45003
    Online unknown
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    A 16 b 2 GHz digital-to-analog converter in 0.18 μm CMOS with digital calibration technology
    Tiehu, Li ; Weidong, Yang ; et al.
    In: Journal of Semiconductors, Jg. 36 (2015-10-01), S. 105002-105002
    Online unknown
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    A 0.23 pJ 11.05-bit ENOB 125-MS/s pipelined ADC in a 0.18 μm CMOS process
    Wei, Zhang ; Jian-Yun, Zhang ; et al.
    In: Journal of Semiconductors, Jg. 36 (2015-05-01), S. 055013-55013
    Online unknown
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    An ultra-low-power area-efficient non-volatile memory in a 0.18 μm single-poly CMOS process for passive RFID tags
    Baiqin, Zhao ; Nanjian, Wu ; et al.
    In: Journal of Semiconductors, Jg. 34 (2013-08-01), S. 085004-85004
    Online unknown
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    Design and implementation of a reconfigurable mixed-signal SoC based on field programmable analog arrays
    Deng, Jun ; Gao, Yuhan ; et al.
    In: Journal of Semiconductors, Jg. 38 (2017-11-01), S. 115001-115001
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    A 10-bit 120-MS/s pipelined ADC with improved switch and layout scaling strategy
    Fule, Li ; Lili, Xu ; et al.
    In: Journal of Semiconductors, Jg. 36 (2015-08-01), S. 085008-85008
    Online unknown
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    An IO block array in a radiation-hardened SOI SRAM-based FPGA
    Fang, Yu ; Jian, Wang ; et al.
    In: Journal of Semiconductors, Jg. 33 (2012), S. 015010-15010
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    A new FPGA architecture suitable for DSP applications
    Xueyan, Duan ; Yuan, Wang ; et al.
    In: Journal of Semiconductors, Jg. 32 (2011-05-01), S. 055012-55012
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    High-resolution 1 MS/s sub-2 radix split-capacitor SAR ADC
    Zhu, Zhangming ; Cao, Chao
    In: Journal of Semiconductors, Jg. 38 (2017-10-01), S. 105008-105008
    Online unknown
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  11. Detailansicht für Treffer 11 öffnen
    A 750 MHz semi-digital clock and data recovery circuit with 10−12BER
    Xueming, Wei ; Yiwen, Wang ; et al.
    In: Journal of Semiconductors, Jg. 32 (2011-12-01), S. 125009-125009
    Online unknown
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    An 8-bit 100-MS/s pipelined ADC without dedicated sample-and-hold amplifier
    Yawei, Guo ; Xiaoyang, Zeng ; et al.
    In: Journal of Semiconductors, Jg. 31 (2010-07-01), S. 075006-75006
    Online unknown
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