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    Design and area optimization of CMOS operational amplifier circuit using hybrid flower pollination algorithm for IoT end-node devices.
    Sasikumar, A. ; Subramaniyaswamy, V. ; et al.
    In: Microprocessors & Microsystems, Jg. 93 (2022-09-01), S. N.PAG
    academicJournal
    Wie komme ich dran?
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    A fuzzy Anti-lock braking system (ABS) controller using CMOS circuits.
    Mokarram, Majid ; Khoei, Abdollah ; et al.
    In: Microprocessors & Microsystems, Jg. 70 (2019-10-01), S. 47-52
    academicJournal
    Wie komme ich dran?
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    A CMOS slew-rate enhanced OTA for imaging.
    Freitas, Luis Miguel Carvalho ; Dias, Morgado
    In: Microprocessors & Microsystems, Jg. 72 (2020-02-01), S. N.PAG
    academicJournal
    Wie komme ich dran?
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    Ultra-low voltage and energy efficient adders in 28 nm FDSOI exploring poly-biasing for device sizing.
    Vatanjou, Ali Asghar ; Låte, Even ; et al.
    In: Microprocessors & Microsystems, Jg. 56 (2018-02-01), S. 92-100
    academicJournal
    Wie komme ich dran?
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    Design and analysis of area efficient QCA based reversible logic gates.
    Singh, Gurmohan ; Sarin, R.K. ; et al.
    In: Microprocessors & Microsystems, Jg. 52 (2017-07-01), S. 59-68
    academicJournal
    Wie komme ich dran?
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    Comparative analysis of adiabatic logic challenges for low power CMOS circuit designs.
    Kumar, Dinesh ; Kumar, Manoj
    In: Microprocessors & Microsystems, Jg. 60 (2018-07-01), S. 107-121
    academicJournal
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    Performance modeling of CMOS inverters using support vector machines (SVM) and adaptive sampling.
    Satyanarayana, Ashwin
    In: Microprocessors & Microsystems, Jg. 46 (2016-10-02), S. 193-201
    academicJournal
    Wie komme ich dran?
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    Ultra low energy design exploration of digital decimation filters in 65nm dual-V <subscript>T</subscript> CMOS in the sub-V <subscript>T</subscript> domain.
    Yasser Sherazi, S.M. ; Rodrigues, Joachim N. ; et al.
    In: Microprocessors & Microsystems, Jg. 37 (2013-06-01), Heft 4/5, S. 494-504
    academicJournal
    Wie komme ich dran?
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    A 13 bits 4.096 GHz 45 nm CMOS digital decimation filter chain with Carry-Save format numbers.
    Huang, Yanxiang ; Kapoor, Ajay ; et al.
    In: Microprocessors & Microsystems, Jg. 39 (2015-11-01), Heft 8, S. 869-878
    academicJournal
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    Design and analysis of CMOS RF receiver front-end of LNA for wireless applications.
    Mudavath, Mahesh ; Kishore, K Hari ; et al.
    In: Microprocessors & Microsystems, Jg. 75 (2020-06-01), S. N.PAG
    academicJournal
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    Low-complexity FFT/IFFT IP hardware macrocells for OFDM and MIMO–OFDM CMOS transceivers
    Saponara, Sergio ; L’Insalata, Nicola E. ; et al.
    In: Microprocessors & Microsystems, Jg. 33 (2009-05-01), Heft 3, S. 191-200
    academicJournal
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    Design of Differential LNA and Double Balanced Mixer using 180 nm CMOS Technology.
    Kalamani, C.
    In: Microprocessors & Microsystems, Jg. 71 (2019-11-01), S. N.PAG
    academicJournal
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    An α-factor architecture for RS decoder implemented on 90 nm CMOS technology for computer computing applications devices.
    Mageswari, N. ; Mahadevan, K. ; et al.
    In: Microprocessors & Microsystems, Jg. 71 (2019-11-01), S. N.PAG
    academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    Design and measurement of a variable-rate Viterbi decoder in 130-nm digital CMOS
    Kamuf, Matthias ; Rodrigues, Joachim Neves ; et al.
    In: Microprocessors & Microsystems, Jg. 34 (2010-08-01), Heft 5, S. 129-137
    academicJournal
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    An ultra low power CMOS based temperature to digital converter in 0.045 µm technology.
    Unnisa, Rafath ; Chari, K. Manjunatha
    In: Microprocessors & Microsystems, Jg. 77 (2020-09-01), S. N.PAG
    academicJournal
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    A 0.9-V 50-MHz 256-bit 1D-to-2D-based single/multi-match priority encoder with 0.67-nW standby power on 65-nm SOTB CMOS.
    Nguyen, Xuan-Thuan ; Hoang, Trong-Thuc ; et al.
    In: Microprocessors & Microsystems, Jg. 73 (2020-03-01), S. N.PAG
    academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    Low power aware standard cells using dual rail multi threshold null convention logic methodology.
    Suresh, M. ; Panda, A.K. ; et al.
    In: Microprocessors & Microsystems, Jg. 68 (2019-07-01), S. 28-33
    academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    A comparative analysis of VLSI trusted virtual sensors.
    Martínez-Rodríguez, Macarena C. ; Brox, Piedad ; et al.
    In: Microprocessors & Microsystems, Jg. 61 (2018-09-01), S. 108-116
    academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    HNCP: A many-core microprocessor ASIC approach dedicated to embedded image processing applications.
    Boussadi, Mohamed Amine ; Tixier, Thierry ; et al.
    In: Microprocessors & Microsystems, Jg. 47 (2016-11-02), S. 333-346
    academicJournal
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  20. Detailansicht für Treffer 20 öffnen
    The electronic interface for quantum processors.
    van Dijk, J.P.G. ; Charbon, E. ; et al.
    In: Microprocessors & Microsystems, Jg. 66 (2019-04-01), S. 90-101
    academicJournal
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