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    A 4-Bit 1GS/s Folding Flash ADC using 45-nm CMOS Technology
    Soman, Vanitha ; Mande, Sudhakar
    In: Microprocessors and Microsystems, 2020-11-01, S. 103512-103512
    Online unknown
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    VLSI implementation of ultra power optimized adiabatic logic based full adder cell
    Baulkani, S. ; Murugan, K.
    In: Microprocessors and Microsystems, Jg. 70 (2019-10-01), S. 15-20
    Online unknown
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    Ultra-low voltage and energy efficient adders in 28 nm FDSOI exploring poly-biasing for device sizing
    Aunet, Snorre ; Late, Even ; et al.
    In: Microprocessors and Microsystems, Jg. 56 (2018-02-01), S. 92-100
    Online unknown
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    An area- and energy-efficient hybrid architecture for floating-point FFT computations
    Li, Zhaolin ; Wang, Mingyu
    In: Microprocessors and Microsystems, Jg. 65 (2019-03-01), S. 14-22
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    Asynchronous hardware implementations for crypto primitives
    Mohamed Asan Basiri, M ; Shukla, Sandeep K.
    In: Microprocessors and Microsystems, Jg. 64 (2019-02-01), S. 221-236
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    Design and implementation of low power and high speed multiplier using quaternary carry look-ahead adder
    Muralidharan, V. ; N. Sathish Kumar
    In: Microprocessors and Microsystems, Jg. 75 (2020-06-01), S. 103054-103054
    Online unknown
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    Modified dynamic current mode logic based LFSR for low power applications
    Anand, Bulusu ; A Suresh Babu
    In: Microprocessors and Microsystems, Jg. 72 (2020-02-01), S. 102945-102945
    Online unknown
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    Minimization of digital logic gates and ultra-low power AES encryption core in 180CMOS technology
    R. Gowri Shankar Rao ; Nandan, V.
    In: Microprocessors and Microsystems, Jg. 74 (2020-04-01), S. 103000-103000
    Online unknown
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    High-throughput low-area design of AES using constant binary matrix-vector multiplication
    Han, Youngsun ; Seon Wook Kim ; et al.
    In: Microprocessors and Microsystems, Jg. 47 (2016-11-01), S. 360-368
    Online unknown
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