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    Mitigating Memory Wall Effects in High-Clock-Rate and Multicore CMOS 3-D Processor Memory Stacks
    Jacob, P. ; Zia, A. ; et al.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 97 (2009), Heft 1, S. 108-122
    Online academicJournal
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    Digital Circuit Design Challenges and Opportunities in the Era of Nanoscale CMOS
    Calhoun, B. H. ; Cao, Y. ; et al.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 96 (2008-02-01), Heft 2, S. 343-365
    Online academicJournal
    Zugriff:
    Volltext
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    Superconducting digital electronics
    Hayakawa, H. ; Yoshikawa, N. ; et al.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 92 (2004-10-01), Heft 10, S. 1549-1563
    Online academicJournal
    Zugriff:
    Volltext
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  4. Detailansicht für Treffer 4 öffnen
    Near-Threshold Computing: Reclaiming Moore's Law Through Energy Efficient Integrated Circuits
    Dreslinski, R. G. ; Wieckowski, M. ; et al.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 98 (2010-02-01), Heft 2, S. 253-266
    Online academicJournal
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    Volltext
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    Ultralow-Power Operation in Subthreshold Regimes Applying Clockless Logic
    Jorgenson, R. D. ; Sorensen, L. ; et al.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 98 (2010-02-01), Heft 2, S. 299-314
    Online academicJournal
    Zugriff:
    Volltext
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  6. Detailansicht für Treffer 6 öffnen
    A new RTD-FET logic family
    Mathews, R.H. ; Sage, J.P. ; et al.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 87 (1999-04-01), Heft 4, S. 596-605
    Online academicJournal
    Zugriff:
    Volltext
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    Designing asynchronous circuits for low power: an IFIR filter bank for a digital hearing aid
    Nielsen, L.S. ; Sparso, J.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 87 (1999-02-01), Heft 2, S. 268-281
    Online academicJournal
    Zugriff:
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  8. Detailansicht für Treffer 8 öffnen
    Rationale and challenges for optical interconnects to electronic chips
    Miller, D.A.B.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 88 (2000-06-01), Heft 6, S. 728-749
    Online academicJournal
    Zugriff:
    Volltext
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  9. Detailansicht für Treffer 9 öffnen
    Aspects of systems and circuits for nanoelectronics
    Goser, K.F. ; Pacha, C. ; et al.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 85 (1997-04-01), Heft 4, S. 558-573
    Online academicJournal
    Zugriff:
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  10. Detailansicht für Treffer 10 öffnen
    Prolog to: Asynchronous design methodologies: An overview
    Caruthers, F.E.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 83 (1995), Heft 1, S. 67-68
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    Technological design considerations for monolithic MOS switched-capacitor filtering systems
    Allstot, D.J. ; Black, W.C., Jr.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 71 (1983-08-01), Heft 8, S. 967-986
    Online academicJournal
    Zugriff:
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  12. Detailansicht für Treffer 12 öffnen
    Parallel bit-level pipelined VLSI designs for high-speed signal processing
    Hatamian, M. ; Cash, G.L.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 75 (1987-09-01), Heft 9, S. 1192-1202
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Microprocessors—The first twelve years
    Gupta, A. ; Toong, H.-M.D.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 71 (1983-11-01), Heft 11, S. 1236-1256
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    Two FIFO ring performance experiments
    Molnar, C.E. ; Jones, I.W. ; et al.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 87 (1999-02-01), Heft 2, S. 297-307
    Online academicJournal
    Zugriff:
    Volltext
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    TMR crystal controlled clock
    Ali, K.S.A. ; Reddy, V.C.V.P.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 69 (1981-06-01), Heft 6, S. 756-757
    Online academicJournal
    Zugriff:
    Volltext
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