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    A 0.18-μm CMOS front-end processor for a Blu-Ray Disc recorder with an adaptive PRML
    GOANG SEOG, CHOI ; JOO SEON, KIM ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 342-350
    Online Konferenz
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    A 4-GHz 300-mW 64-bit integer execution ALU with dual supply voltages in 90-nm CMOS
    MATHEW, Sanu K ; ANDERS, Mark A ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 44-51
    Online Konferenz
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    Volltext
    Wie komme ich dran?
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    A 0.16-2.55-GHz CMOS active clock deskewing PLL using analog phase interpolation
    MAXIM, Adrian
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 110-131
    Online Konferenz
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Architecture and circuit techniques for a 1.1-GHz 16-kb reconfigurable memory in 0.18-μm CMOS
    KEN, MAI ; RON, HO ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 261-275
    Online Konferenz
    Zugriff:
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    A design for a minimum hamming-distance search using asynchronous digital techniques
    NAKAHARA, Shigeru ; KAWATA, Takahiro
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 276-285
    Online Konferenz
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    Wie komme ich dran?
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    A 3.6-Gb/s point-to-point heterogeneous-voltage-capable DRAM interface for capacity-scalable memory subsystems
    KENNEDY, Joseph ; MOONEY, Randy ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 233-244
    Online Konferenz
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    A cost-efficient high-performance dynamic TCAM with pipelined hierarchical searching and shift redundancy architecture
    NODA, Hideyuki ; INOUE, Kazunari ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 245-253
    Online Konferenz
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    A 64-bit microprocessor in 130-nm and 90-nm technologies with power management features
    ROHRER, Norman J ; LICHTENAU, Cédric ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 19-27
    Online Konferenz
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    A 312-MHz 16-Mb random-cycle embedded DRAM macro with a power-down data retention mode for mobile applications
    MORISHITA, Fukashi ; HAYASHI, Isamu ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 204-212
    Online Konferenz
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  10. Detailansicht für Treffer 10 öffnen
    Mixed body bias techniques with fixed Vt and Idsgeneration circuits
    SUMITA, Masaya ; SAKIYAMA, Shiro ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 60-66
    Online Konferenz
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    Dynamic voltage and frequency Management for a low-power embedded microprocessor
    NAKAI, Masakatsu ; AKUI, Satoshi ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 28-35
    Online Konferenz
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    A dual-core 64-bit ultraSPARC microprocessor for dense server applications
    TAKAYANAGI, Toshinari ; JINUK LUKE, SHIN ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 7-18
    Online Konferenz
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    A 4-Gb/s/pin low-power memory I/O interface using 4-level Simultaneous Bi-directional signaling
    KIM, Jin-Hyun ; KIM, Sua ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 89-101
    Online Konferenz
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    A 4-MB on-chip L2 cache for a 90-nm 1.6-GHz 64-bit microprocessor
    MCINTYRE, Hugh ; WENDELL, Dennis ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 52-59
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  15. Detailansicht für Treffer 15 öffnen
    A 4-Mb 0.18-μm 1T1MTJ Toggle MRAM with balanced three input sensing scheme and locally mirrored unidirectional write drivers
    ANDRE, Thomas W ; NAHAS, Joseph J ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 301-309
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    A 0.7-fj/bit/search 2.2-ns search time hybrid-type TCAM architecture
    CHOI, Sungdae ; SOHN, Kyomin ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 254-260
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    A 0.18-μm 3.0-V 64-Mb nonvolatile phase-transition random access memory (PRAM)
    WOO YEONG, CHO ; CHO, Beak-Hyung ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 293-300
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    1440 x 1080 pixel, 30 frames per second motion-JPEG 2000 codec for HD-movie transmission
    YAMAUCHI, Hideki ; OKADA, Shigeyuki ; et al.
    In: Special issue on the EEEE 2004 ISSCC: Digital, technology directions, memory, and signal processing, Jg. 40 (2005), Heft 1, S. 331-341
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