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    QuBRIM: A CMOS Compatible Resistively-coupled Ising Machine with Quantized Nodal Interactions
    Zhang, Yiqiao ; Vengalam, Uday Kumar Reddy ; et al.
    In: 2022 IEEE/ACM International Conference On Computer Aided Design (ICCAD), 2022-10-29, S. 1-8
    Online Konferenz
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    CMOS Analog Four-Quadrant Multiplier Free of Voltage Reference Generators
    Sobrinho de Sousa, Antonio Jose ; de Andrade, Fabian ; et al.
    In: 2019 32nd Symposium on Integrated Circuits and Systems Design (SBCCI), 2019-08-01, S. 1-6
    Online Konferenz
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    An IR-UWB Pulse Generator using PAM Modulation with Adaptive PSD in 130nm CMOS Process
    Moreira, Luiz Carlos ; Neto, Jose Fontebasso ; et al.
    In: 2019 32nd Symposium on Integrated Circuits and Systems Design (SBCCI), 2019-08-01, S. 1-6
    Online Konferenz
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    Estimation methods for static noise margins in CMOS subthreshold logic circuits
    Bortolon, Felipe T. ; Moreira, Matheus T ; et al.
    In: 2017 30th Symposium on Integrated Circuits and Systems Design (SBCCI), 2017-08-01, S. 90-95
    Online Konferenz
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    A 34fJ/conversion-step 10-bit 6.66MS/s SAR ADC with built-in digital calibration in 130nm CMOS
    Makara, Felipe ; Mangini, Lucas ; et al.
    In: 2017 30th Symposium on Integrated Circuits and Systems Design (SBCCI), 2017-08-01, S. 180-184
    Online Konferenz
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    A class-J power amplifier for 5G applications in 28nm CMOS FD-SOI technology
    Hanna, Tony ; Deltimple, Nathalie ; et al.
    In: 2017 30th Symposium on Integrated Circuits and Systems Design (SBCCI), 2017-08-01, S. 110-113
    Online Konferenz
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    Performance modeling for emerging interconnect technologies in CMOS and beyond-CMOS circuits
    Chang, Sou-Chi ; Ceyhan, Ahmet ; et al.
    In: 2014 IEEE/ACM International Symposium on Low Power Electronics and Design (ISLPED), 2014-08-01, S. 63-68
    Konferenz
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    Design of a low power 10-bit 12MS/s asynchronous SAR ADC in 65nm CMOS
    Campos, Arthur Lombardi ; Navarro, Joao ; et al.
    In: 2019 32nd Symposium on Integrated Circuits and Systems Design (SBCCI), 2019-08-01, S. 1-6
    Online Konferenz
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    Challenges in low-power analog circuit design for sub-28nm CMOS technologies
    Fahim, Amr
    In: 2014 IEEE/ACM International Symposium on Low Power Electronics and Design (ISLPED), 2014-08-01, S. 123-126
    Konferenz
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    Fine-grained 3-D CMOS concept using stacked horizontal nanowire
    Macha, Naveen Kumar ; Iqbal, Md Arif ; et al.
    In: 2016 IEEE/ACM International Symposium on Nanoscale Architectures (NANOARCH), 2016-07-01, S. 151-152
    Konferenz
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    Routability in 3D IC design: Monolithic 3D vs. Skybridge 3D CMOS
    Shi, Jiajun ; Li, Mingyu ; et al.
    In: 2016 IEEE/ACM International Symposium on Nanoscale Architectures (NANOARCH), 2016-07-01, S. 145-150
    Konferenz
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    Nonvolatile online CMOS trimming with magnetic tunnel junctions
    Dutta, Sumit ; Price, Michael ; et al.
    In: 2016 IEEE/ACM International Symposium on Nanoscale Architectures (NANOARCH), 2016-07-01, S. 61-66
    Konferenz
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  13. Detailansicht für Treffer 13 öffnen
    DARWIN: CMOS opamp Synthesis by Means of a Genetic Algorithm
    Wim Kruiskamp, Domine Leenaerts
    In: 32nd Design Automation Conference, 1995, S. 433-438
    Online Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    Performance Enhancement of CMOS VLSI Circuits by Transistor Reordering
    Carlson, B.S. ; Chen, C.Y.R.
    In: 30th ACM/IEEE Design Automation Conference, 1993, S. 361-366
    Online Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    Resolving Signal Correlations for Estimating Maximum Currents in CMOS Combinational Circuits
    Kriplani, H. ; Najm, F. ; et al.
    In: 30th ACM/IEEE Design Automation Conference, 1993, S. 384-388
    Online Konferenz
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  16. Detailansicht für Treffer 16 öffnen
    Bridge Fault Simulation Strategies for CMOS Integrated Circuits
    Chess, B. ; Larrabee, T.
    In: 30th ACM/IEEE Design Automation Conference, 1993, S. 458-462
    Online Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    Accurate and Efficient Fault Simulation of Realistic CMOS Network Breaks
    Haluk Konuk, F. Joel Ferguson, Tracy Larrabee
    In: 32nd Design Automation Conference, 1995, S. 345-351
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  18. Detailansicht für Treffer 18 öffnen
    Stochastic Optimization Approach to Transistor Sizing for CMOS VLSI Circuits
    Mehrotra, S. ; Franzon, P. ; et al.
    In: 31st Design Automation Conference, 1994, S. 36-40
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  19. Detailansicht für Treffer 19 öffnen
    A Gate-Delay Model for High-Speed CMOS Circuits
    Dartu, F. ; Menezes, N. ; et al.
    In: 31st Design Automation Conference, 1994, S. 576-580
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    A Rule-Based Circuit Representation for Automated CMOS Design and Verification
    Wu, C.-F.E. ; Wojcik, A.S. ; et al.
    In: 24th ACM/IEEE Design Automation Conference, 1987, S. 786-792
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