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    Solution-Processed Organic and Oxide Hybrid CMOS Inverter for Low Cost Electronic Circuits
    Cho, Jae-Hyeok ; Kyeong Min Yu ; et al.
    In: Journal of Nanoscience and Nanotechnology, Jg. 20 (2020-07-01), S. 4381-4384
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    Monolithic-3D (M3D) Complementary Metal-Oxide-Semiconductor-Nanoelectromechanical (CMOS-NEM) Hybrid Reconfigurable Logic (RL) Circuits
    Woo Young Choi ; Ji Wang Ko
    In: Journal of Nanoscience and Nanotechnology, Jg. 20 (2020-07-01), S. 4176-4181
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    Performance Benchmarking of 32 nm Predictive Technology Model CMOS with Silicon Nanowire Physic-Based Compact Model of Field-Effect Transistors for Digital Logic Applications
    Nazril Hafiz Bin Mohamad ; Huei Chaeng Chin ; et al.
    In: Science of Advanced Materials, Jg. 6 (2014-03-01), S. 596-602
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    Adaptive Thermal Monitoring of Deep-Submicron CMOS VLSI Circuits
    Rene van Leuken ; Nick van der Meijs ; et al.
    In: Journal of Low Power Electronics, Jg. 9 (2013-12-01), S. 403-413
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    Co-Integration of Nano-Scale Vertical- and Horizontal-Channel Metal-Oxide-Semiconductor Field-Effect Transistors for Low Power CMOS Technology
    Kim, Garam ; Shin, Hyungcheol ; et al.
    In: Journal of Nanoscience and Nanotechnology, Jg. 12 (2012-07-01), S. 5313-5317
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    SPICE Macromodel and CMOS Emulator for Memristors
    Jung, Chul-Moon ; Jo, Kwan-Hee ; et al.
    In: Journal of Nanoscience and Nanotechnology, Jg. 12 (2012-02-01), S. 1487-1491
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    Hybrid CMOS-SET Arithmetic Circuit Design Using Coulomb Blockade Oscillation Characteristic
    Deng, Guoqing ; Chen, Chunhong
    In: Journal of Computational and Theoretical Nanoscience, Jg. 8 (2011-08-01), S. 1520-1526
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    CrossNets: Neuromorphic Hybrid CMOS/Nanoelectronic Networks
    Likharev, Konstantin K.
    In: Science of Advanced Materials, Jg. 3 (2011-06-01), S. 322-331
    Online unknown
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    A New Cell Design Methodology for Balanced XOR–XNOR Circuits for Hybrid-CMOS Logic
    Navi, Keivan ; Eslami, Fatemeh ; et al.
    In: Journal of Low Power Electronics, Jg. 5 (2009-12-01), S. 474-483
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  10. Detailansicht für Treffer 10 öffnen
    Performance Analysis of Subthreshold Cascode Current Mirror in 130 nm CMOS Technology
    Bhat, Navakanta ; Jayaraman, Balaji
    In: Journal of Low Power Electronics, Jg. 5 (2009-12-01), S. 484-496
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  11. Detailansicht für Treffer 11 öffnen
    Thermal-Aware Design Techniques for Nanometer CMOS Circuits
    Macii, Alberto ; Sathanur, A. ; et al.
    In: Journal of Low Power Electronics, Jg. 4 (2008-12-01), S. 374-384
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  12. Detailansicht für Treffer 12 öffnen
    Performance Analysis of Voltage-Scaled Static and Dynamic CMOS Circuits
    Chandel, Rajeevan ; Khanna, Gargi ; et al.
    In: Journal of Nanoelectronics and Optoelectronics, Jg. 3 (2008-07-01), S. 171-176
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    An On-Chip Multi-Mode Buck DC–DC Converter for Fine-Grain DVS on a Multi-Power Domain SoC Using a 65-nm Standard CMOS Logic Process
    Belleville, Marc ; Amara, Amara ; et al.
    In: Journal of Low Power Electronics, Jg. 6 (2010-04-01), S. 201-210
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  14. Detailansicht für Treffer 14 öffnen
    Ultra Low Energy CMOS Logic Using Below-Threshold Dual-Voltage Supply
    Kim, Kyungseok ; Agrawal, Vishwani D.
    In: Journal of Low Power Electronics, Jg. 7 (2011-12-01), S. 460-470
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    CMOS Leakage and Glitch Minimization for Power-Performance Tradeoff
    Agrawal, Vishwani D. ; Lu, Yuanlin
    In: Journal of Low Power Electronics, Jg. 2 (2006-12-01), S. 378-387
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  16. Detailansicht für Treffer 16 öffnen
    Hybrid CMOS/Nanoelectronic Circuits: Opportunities and Challenges
    Likharev, Konstantin K.
    In: Journal of Nanoelectronics and Optoelectronics, Jg. 3 (2008-12-01), S. 203-230
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  17. Detailansicht für Treffer 17 öffnen
    System in Package of Integrated Humidity Sensor Using CMOS-MEMS Technology
    Sung Pil Lee
    In: Journal of Nanoscience and Nanotechnology, Jg. 15 (2015-10-01), S. 7503-7507
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  18. Detailansicht für Treffer 18 öffnen
    A 52.6 mW 10-bit, 100 MS/s Pipelined CMOS Analog-To-Digital Converter
    Moorthi, Sridharan ; J. Raja Paul Perinbam ; et al.
    In: Journal of Low Power Electronics, Jg. 4 (2008-08-01), S. 208-227
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  19. Detailansicht für Treffer 19 öffnen
    Implementation of an Ultra Low Power Process-Insensitive Two Stage Complementary Metal Oxide Semiconductor Operational Amplifier with Enhanced Direct Current Gain at 45 nm Technology Node
    Akashe, Shyam ; Gupta, Pragati
    In: Sensor Letters, Jg. 18 (2020-10-01), S. 770-775
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    Optimized Design of Low Power Complementary Metal Oxide Semiconductor Low Noise Amplifier for Zigbee Application
    Karthikeyan, R. ; Karthick, S. ; et al.
    In: Journal of Computational and Theoretical Nanoscience, Jg. 18 (2021-04-01), S. 1327-1330
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