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    CMOS Phase-Locked Loop Circuits and Hot Carrier Effects
    YANG, LIU ; SRIVASTAVA, Ashok
    In: Power, Parasitics, and Process-Variation (P3) Awareness in Mixed-Signal Design, Jg. 8 (2012), Heft 3, S. 304-316
    academicJournal
    Wie komme ich dran?
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    CMOS Proportional-to-Absolute Temperature Current Reference for Low Voltage Operation
    SANJAY KUMAR, WADHWA
    In: 22nd IEEE International Conference on VLSI Design, New Delhi, India, 2009, Jg. 5 (2009), Heft 3, S. 257-264
    academicJournal
    Wie komme ich dran?
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    Process Variation Tolerant FinFET Based Robust Low Power SRAM Cell Design at 32 nm Technology
    RAJ, Balwinder ; MITRA, Jatin ; et al.
    In: Journal of low power electronics (Print), Jg. 7 (2011), Heft 2, S. 163-171
    academicJournal
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    Design and Simulation of a Sequence Generator using Single Electron Devices and Hybrid Architecture
    SAMANTA, Debasis ; GHOSH, Ankush ; et al.
    In: Journal of nanoelectronics and optoelectronics, Jg. 5 (2010), Heft 3, S. 323-331
    academicJournal
    Wie komme ich dran?
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    Robust and Ultra Low Power Subthreshold Logic Circuits with Symmetric, Asymmetric, 3T, 4T DGFinFETs
    VADDI, Ramesh ; DASGUPTA, S ; et al.
    In: Journal of low power electronics (Print), Jg. 6 (2010), Heft 1, S. 103-114
    academicJournal
    Wie komme ich dran?
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sm 576 - 768
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