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    PVT variations aware low leakage INDEP approach for nanoscale CMOS circuits
    VIJAY KUMAR, SHARMA ; PATTANAIK, Manisha ; et al.
    In: Microelectronics and reliability, Jg. 54 (2014), Heft 1, S. 90-99
    academicJournal
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    ISGP: Iterative sequential geometric programming for precise and robust CMOS analog circuit sizing
    KUNDU, Sudip ; MANDAL, Pradip
    In: Integration (Amsterdam), Jg. 47 (2014), Heft 4, S. 510-531
    academicJournal
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    Process variation aware dual-Vth assignment technique for low power nanoscale CMOS design
    MANDE, Sudhakar S ; CHANDORKAR, Saurabh A ; et al.
    In: Microelectronics and reliability, Jg. 51 (2011), Heft 12, S. 2357-2365
    academicJournal
    Wie komme ich dran?
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    Standby power consumption estimation by interacting leakage current mechanisms in nanoscaled CMOS digital circuits
    BUTZEN, Paulo F ; DA ROSA, Leomar S ; et al.
    In: Microelectronics journal, Jg. 41 (2010), Heft 4, S. 247-255
    academicJournal
    Wie komme ich dran?
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    Statistical DOE―ILP based power―performance-process (P3) optimization of nano-CMOS SRAM
    MOHANTY, Saraju P ; SINGH, Jawar ; et al.
    In: Integration (Amsterdam), Jg. 45 (2012), Heft 1, S. 33-45
    academicJournal
    Wie komme ich dran?
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    Enhanced source-degenerated CMOS differential transconductor
    MARTINEZ-HEREDIA, J. M ; TORRALBA, A
    In: Microelectronics journal, Jg. 42 (2011), Heft 2, S. 396-402
    academicJournal
    Wie komme ich dran?
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    The effect of photodiode shape on charge transfer in CMOS image sensors
    BHUMJAE, SHIN ; PARK, Sangsik ; et al.
    In: Solid-state electronics, Jg. 54 (2010), Heft 11, S. 1416-1420
    academicJournal
    Wie komme ich dran?
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    Logical effort based dynamic power estimation and optimization of static CMOS circuits
    KABBANI, A
    In: Integration (Amsterdam), Jg. 43 (2010), Heft 3, S. 279-288
    academicJournal
    Wie komme ich dran?
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    Third-order nonlinearity vs. load impedance for CMOS low-noise amplifiers
    ASPEMYR, Lars ; SJÖLAND, Henrik
    In: AMF/RF[AMS/RF] CMOS Circuit Design for Wireless Transceivers, Jg. 42 (2009), Heft 1, S. 89-94
    academicJournal
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    Impact of gate-oxide tunneling on mixed-signal design and simulation of a nano-CMOS VCO
    KOUGIANOS, Elias ; MOHANTY, Saraju P
    In: Microelectronics journal, Jg. 40 (2009), Heft 1, S. 95-103
    academicJournal
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    Gate dielectric degradation in CMOS inverters
    MARTIN-MARTINEZ, J ; GERARDIN, S ; et al.
    In: Microelectronic engineering, Jg. 86 (2009), Heft 10, S. 2123-2126
    academicJournal
    Wie komme ich dran?
  12. Detailansicht für Treffer 12 öffnen
    Modeling of circuits with strongly temperature dependent thermal conductivities for cryogenic CMOS
    HAMLET, J ; ENG, K ; et al.
    In: Microelectronics journal, Jg. 42 (2011), Heft 7, S. 936-941
    academicJournal
    Wie komme ich dran?
  13. Detailansicht für Treffer 13 öffnen
    A CMOS vector lock-in amplifier for sensor applications : Design et Technology of Integrated Systems (DTIS)
    AZZOLINI, Cristiano ; MAGNANINI, Alessandro ; et al.
    In: Microelectronics journal, Jg. 41 (2010), Heft 8, S. 449-457
    academicJournal
    Wie komme ich dran?
  14. Detailansicht für Treffer 14 öffnen
    Transistor chaining in static CMOS functional cells of arbitrary planar topology
    CARLSON, B. S ; CHEN, C. Y. R ; et al.
    In: VLSI, Jg. 90 (1999), Heft 1-3, S. 89-114
    Online academicJournal
    Zugriff:
    View record from ScienceDirect (Volltext)
    Wie komme ich dran?
  15. Detailansicht für Treffer 15 öffnen
    Heterogeneous graphene―CMOS ternary content addressable memory
    KHASANVIS, Santosh ; RAHMAN, Mostafizur ; et al.
    In: Computing with Future Nanotechnology, Jg. 74 (2014), Heft 6, S. 2497-2503
    academicJournal
    Wie komme ich dran?
  16. Detailansicht für Treffer 16 öffnen
    High slew rate current mode transconductance error amplifier for low quiescent current output-capacitorless CMOS LDO regulator
    FATHIPOUR, Rasoul ; SABERKARI, Alireza ; et al.
    In: Integration (Amsterdam), Jg. 47 (2014), Heft 2, S. 204-212
    academicJournal
    Wie komme ich dran?
  17. Detailansicht für Treffer 17 öffnen
    Pareto ANOVA analysis for CMOS 0.18 μm two-stage Op-amp
    SITI AMANIAH MOHD, CHACHULI ; PUTERI NOR AZNIE, FASYAR ; et al.
    In: Materials science in semiconductor processing, Jg. 24 (2014), S. 9-14
    academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    Low-power compact composite field AES S-Box/Inv S-Box design in 65 nm CMOS using Novel XOR Gate
    AHMAD, Nabihah ; REZAUL HASAN, S. M
    In: Integration (Amsterdam), Jg. 46 (2013), Heft 4, S. 333-344
    academicJournal
    Wie komme ich dran?
  19. Detailansicht für Treffer 19 öffnen
    The impact of process-induced mechanical stress on CMOS buffer design using multi-fingered devices
    ALAM, Naushad ; ANAND, Bulusu ; et al.
    In: Microelectronics and reliability, Jg. 53 (2013), Heft 3, S. 379-385
    academicJournal
    Wie komme ich dran?
  20. Detailansicht für Treffer 20 öffnen
    CMOS WTA maximum and minimum circuits with their applications to analog switch and rectifiers
    PROMMEE, Pipat ; CHATTRAKUN, Kittikhun
    In: Microelectronics journal, Jg. 42 (2011), Heft 1, S. 52-62
    academicJournal
    Wie komme ich dran?
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