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    Predictions of CMOS compatible on-chip optical interconnect
    GUOQING, CHEN ; HUI, CHEN ; et al.
    In: Integration (Amsterdam), Jg. 40 (2007), Heft 4, S. 434-446
    Konferenz
    Wie komme ich dran?
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    A new approach to power estimation and reduction in CMOS digital circuits
    BRZOZOWSKI, Ireneusz ; KOS, Andrzej
    In: Integration (Amsterdam), Jg. 41 (2008), Heft 2, S. 219-237
    academicJournal
    Wie komme ich dran?
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    FROSTY : A program for fast extraction of high-level structural representation from circuit description for industrial CMOS circuits
    LEI, YANG ; SHI, C.-J. Richard
    In: Integration (Amsterdam), Jg. 39 (2006), Heft 4, S. 311-339
    academicJournal
    Wie komme ich dran?
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    1-V quasi constant-gm input/output rail-to-rail CMOS op-amp
    CARRILLO, Juan M ; DUQUE-CARRILLO, J. Francisco ; et al.
    In: Analog and mixed-signal IC design and design methodologies, Jg. 36 (2003), Heft 4, S. 161-174
    academicJournal
    Wie komme ich dran?
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    Aslic : A low power CMOS analog circuit design automation
    LEE, Jihyun ; KIM, Yong-Bin
    In: Integration (Amsterdam), Jg. 39 (2006), Heft 3, S. 157-181
    academicJournal
    Wie komme ich dran?
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    Fault security analysis of CMOS VLSI circuits using defect-injectable VHDL models
    SHAW, Donald ; AL-KHALILI, Dhamin ; et al.
    In: Integration (Amsterdam), Jg. 32 (2002), Heft 1-2, S. 77-97
    academicJournal
    Wie komme ich dran?
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    Synthesis of low-power CMOS circuits using hybrid topologies
    GALLANT, M ; AL-KHALILI, D
    In: Integration (Amsterdam), Jg. 27 (1999), Heft 2, S. 143-163
    academicJournal
    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    Waveform analysis and delay prediction for a CMOS gate driving RLC interconnect load
    BRAJESH KUMAR, KAUSHIK ; SARKAR, Sankar ; et al.
    In: Integration (Amsterdam), Jg. 40 (2007), Heft 4, S. 394-405
    Konferenz
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    Characterization of logic circuit techniques and optimization for high-leakage CMOS technologies
    CHIN, Phillip ; ZUKOWSKI, Charles A ; et al.
    In: ACM Great Lakes Symposium on VLSI, Jg. 38 (2005), Heft 3, S. 491-504
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    Variability in nanometer CMOS : Impact, analysis, and minimization
    SYLVESTER, Dennis ; AGARWAL, Kanak ; et al.
    In: Integration (Amsterdam), Jg. 41 (2008), Heft 3, S. 319-339
    academicJournal
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    Delay and noise estimation of CMOS logic gates driving coupled resistive-capacitive interconnections
    TANG, Kevin T ; FRIEDMAN, Eby G
    In: Integration (Amsterdam), Jg. 29 (2000), Heft 2, S. 131-165
    academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    A modem in CMOS technology for data communication on the low-voltage power line
    GUERRA, O ; DOMINGUEZ-MATAS, C. M ; et al.
    In: Analog and mixed-signal IC design and design methodologies, Jg. 36 (2003), Heft 4, S. 229-236
    academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Design of a high-speed, low-noise CMOS data output buffer
    HAQUE, Rezaul ; SENDROWSKI, Andrzej ; et al.
    In: Integration (Amsterdam), Jg. 39 (2006), Heft 3, S. 252-266
    academicJournal
    Wie komme ich dran?
  14. Detailansicht für Treffer 14 öffnen
    Combinatorial cell design for CMOS libraries
    BEEFTINK, F ; KUDVA, P ; et al.
    In: Timing Closure, Jg. 29 (2000), Heft 1, S. 67-93
    academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    A new modeling technique for mixed-mode simulation of CMOS circuits
    SAMUDRA, G ; LEE, T. K
    In: Integration (Amsterdam), Jg. 22 (1997), Heft 1-2, S. 87-99
    academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    2.0 V bipolar/CMOS differential logic methodology for iterative network implementation
    SIMION, V
    In: Integration (Amsterdam), Jg. 16 (1993), Heft 2, S. 163-177
    academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    Testing CMOS combinational iterative logic arrays for realistic faults
    GIZOPOULOS, D ; NIKOLOS, D ; et al.
    In: Integration (Amsterdam), Jg. 21 (1996), Heft 3, S. 209-228
    academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    iCOACH: a circuit optimization aid for CMOS high-performance circuits
    CHEN, H. Y ; KANG, S. M
    In: Integration (Amsterdam), Jg. 10 (1991), Heft 2, S. 185-212
    academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    Transistor sizing for large combinational digital CMOS circuits
    HEUSLER, L. S ; FICHTNER, W
    In: Integration (Amsterdam), Jg. 10 (1991), Heft 2, S. 155-168
    academicJournal
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  20. Detailansicht für Treffer 20 öffnen
    Partitioning and ordering of CMOS circuits for switch level analysis
    PAYER, M
    In: Integration (Amsterdam), Jg. 10 (1991), Heft 2, S. 113-141
    academicJournal
    Wie komme ich dran?
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