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    Area Efficient Layout Design of CMOS Comparator using PTL Logic
    Jyoti ; Mehra, Rajesh
    In: International Journal of Computer Applications, Jg. 122 (2015-07-18), S. 14-17
    Online unknown
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    Illustrative Comparison of MCML and CMOS Design Techniques using Tanner EDA
    Vyas, Keerti ; Mathur, Rajeev ; et al.
    In: International Journal of Computer Applications, Jg. 118 (2015-05-20), S. 18-21
    Online unknown
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    Design and Analysis of a Novel Ultra-Low Power SRAM Bit-Cell at 45nm CMOS Technology for Bio-Medical Implants
    Birla, Shilpi ; Yadav, Jyoti ; et al.
    In: International Journal of Computer Applications, Jg. 115 (2015-04-22), S. 1-6
    Online unknown
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    Relative Performance Analysis of Different CMOS Full Adder Circuits
    Chowdhury, Dibyendu ; Bhaumik, Jaydeb ; et al.
    In: International Journal of Computer Applications, Jg. 114 (2015-03-18), S. 8-14
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    Comparative Analysis of Metastability with D FLIP FLOP in CMOS Circuits
    Braj Bihari Soni ; Gaur, Puran ; et al.
    In: International Journal of Computer Applications, Jg. 103 (2014-10-18), S. 26-29
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    Standby Leakage Reduction in Nanoscale CMOS VLSI Circuits
    Deshpande, Pallavi S. ; Upasani, Dhananjay E. ; et al.
    In: International Journal of Computer Applications, Jg. 7 (2010-09-10), S. 1-4
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    DVCC based Readout Circuitry for Water Quality Monitoring System
    Syed Naseem Ahmad ; Whig, Pawan
    In: International Journal of Computer Applications, Jg. 49 (2012-07-31), S. 1-7
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    DTMOS Transistor with Self-Cascode Subcircuit for Achieving High Bandwidth in Analog Applications
    Garg, Shelly ; Niranjan, Vandana
    In: International Journal of Computer Applications, Jg. 127 (2015-10-15), S. 19-31
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    Design of an Effective Charge Pump-Phase Locked Loops Architecture for RF Applications
    Toihria, Intissar ; Masmoudi, Mohamed ; et al.
    In: International Journal of Computer Applications, Jg. 74 (2013-07-26), S. 38-44
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    Performance Analysis of Magnitude Comparator using Different Design Techniques
    Aggarwal, Meena ; Mehra, Rajesh
    In: International Journal of Computer Applications, Jg. 115 (2015-04-22), S. 12-15
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    A Novel High Performance Low Power Universal Gate Implementation in Subthreshold Region
    Dobriyal, Paanshul ; Handa, Ankish ; et al.
    In: International Journal of Computer Applications, Jg. 87 (2014-02-14), S. 21-25
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    A Novel High Performance Dual Threshold Voltage Domino Logic Employing Stacked Transistors
    Rajput, Navya ; Sharma, Karna ; et al.
    In: International Journal of Computer Applications, Jg. 77 (2013-09-18), S. 30-35
    Online unknown
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    Effects of Transistor Sizing on the Performance of PIFA and Low Noise Amplifier Co-Design
    Nischal Kumar Das ; Rizvi, Navaid Z. ; et al.
    In: International Journal of Computer Applications, Jg. 64 (2013-02-15), S. 43-45
    Online unknown
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    A Survey Paper on Semiconductor Technology based Dual Modulus Prescaler
    Shimpi, Nikhil R. ; Kodgire, Shilpa P.
    In: International Journal of Computer Applications, Jg. 62 (2013-01-18), S. 19-21
    Online unknown
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