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    Fault- Tolerance Design Of Memory System Based On DBL Structures : Circuits and systems; APCCAS 2002
    Lu, S. K. ; Hsu, C. H.
    In: IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS, Jg. 1 (2002), S. 221-228
    Konferenz
    Wie komme ich dran?
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    DECOUPLING CAPACITANCE ALLOCATION IN NOISE-AWARE FLOORPLANNING BASED ON DBL REPRESENTATION
    Yan, J. T. ; Lin, K. P. ; et al.
    In: IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS, Jg. 3 (2005), S. 2219-2222
    serialPeriodical
    Wie komme ich dran?
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    1GDRAM Cell with Diagonal Bit-Line (DBL) Configuration and Edge Operation MOS(EOS) FET : Electron devices
    Shibahara, K. ; Mori, H. ; et al.
    In: INTERNATIONAL ELECTRON DEVICES MEETING, , S. 639-642
    Konferenz
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    A 3.3V Single-Power-Supply 64Mb Flash Memory with Dynamic Bit-Line Latch (DBL) Programming Scheme : 41st International solid-state circuits conference
    Takeshima, T. ; Sugawara, H. ; et al.
    In: DIGEST OF TECHNICAL PAPERS OF THE SOLID STATE CIRCUITS CONFERENCE, , S. 148-149
    Konferenz
    Wie komme ich dran?
xs 0 - 576
sm 576 - 768
md 768 - 992
lg 992 - 1200
xl 1200 - 1366
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