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    A 24.5 mW, 10-bit, 50 MS/sec CMOS pipelined analogue-to-digital converter
    MEGANATHAN, D
    In: International journal of high performance systems architecture (Print), Jg. 3 (2011), Heft 4, S. 184-201
    academicJournal
    Wie komme ich dran?
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    Implications of gated-Vss technique on leakage power in embedded caches
    KUDITHIPUDI, Dhireesha ; JOHN, Eugene
    In: Digital Signal Processing, Jg. 4 (2009), Heft 1, S. 17-26
    academicJournal
    Wie komme ich dran?
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    A proposed FPGA architecture for mean shift based object tracking with bandwidth constrained sensors
    WONG, Stefan ; COLLINS, John
    In: International journal of intelligent systems technologies and applications (Print), Jg. 13 (2014), Heft 1-2, S. 3-16
    academicJournal
    Wie komme ich dran?
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    Design, analysis, and implementation of partial product reduction phase by using wide m:3 (4 ≤ m ≤ 10) compressors
    MEHRABI, Shima ; REZA FAGHIH, MIRZAEE ; et al.
    In: International journal of high performance systems architecture (Print), Jg. 4 (2013), Heft 4, S. 231-241
    academicJournal
    Wie komme ich dran?
  5. Detailansicht für Treffer 5 öffnen
    Fixed-priority scheduling to reduce both the dynamic and leakage energy on variable voltage processors
    GANG, QUAN ; LINWEI, NIU ; et al.
    In: LOW-POWER REAL-TIME EMBEDDED COMPUTING, Jg. 4 (2009), Heft 2, S. 127-140
    academicJournal
    Wie komme ich dran?
  6. Detailansicht für Treffer 6 öffnen
    High speed, low power 100 MS/s front end track-and-hold amplifier for ten-bit pipelined ADC
    MEGANATHAN, D ; RAJA PAUL, PERINBAM ; et al.
    In: International journal of high performance systems architecture (Print), Jg. 2 (2009), Heft 1, S. 1-15
    academicJournal
    Wie komme ich dran?
xs 0 - 576
sm 576 - 768
md 768 - 992
lg 992 - 1200
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