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    A physical parametric transistor model for CMOS circuit simulation
    Yu, Sepuan ; Franz, Andrea F. ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. v7 (1988-10-01), Heft n10, S. 1038-1052
    Online academicJournal
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    Optimal chaining of CMOS transistors in a functional cell
    Wimer, Shmuel ; Pinter, Ron Y. ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. v6 (1987-09-01), Heft n5, S. 795-801
    Online academicJournal
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    Volltext
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    Analysis and synthesis of combinational pass transistor circuits
    Pedron, Corrado ; Stauffer, Andre
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. v7 (1988-07-01), Heft n7, S. 775-786
    Online academicJournal
    Zugriff:
    Volltext
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  4. Detailansicht für Treffer 4 öffnen
    Modeling and Test Generation Algorithms for MOS Circuits
    Jain, S.K. ; Agrawal, V.D.
    In: IEEE Transactions on Computers, Jg. 34 (1985-05-01), Heft n5, S. 426
    Online academicJournal
    Zugriff:
    Volltext
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xs 0 - 576
sm 576 - 768
md 768 - 992
lg 992 - 1200
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