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    Optimization, FPGA Implementation & CMOS Realization of Reversible Shift Registers
    Tejaswi, Gopal ; Singh, Rupali
    In: IOSR Journal of Electronics and Communication Engineering, Jg. 11 (2016-04-01), S. 13-22
    Online unknown
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    Optimized Design of Column Level ADC for CMOS Imager using 180 nm Technology
    Mehra, Rajesh ; Yadav, Anurag ; et al.
    In: IOSR Journal of VLSI and Signal Processing, 2016-04-01, S. 20-25
    Online unknown
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    Reduction of Dynamic Power in Hazards for low voltage CMOS Architectures
    Ashok, Arra ; Ravibabu, J. ; et al.
    In: IOSR journal of VLSI and Signal Processing, Jg. 4 (2014), S. 33-37
    Online unknown
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    CMOS Form of Wallace Range Exploitation Domino Logic Full Adder
    thakur, Shweta ; Kolhe, Deepali S. ; et al.
    In: IOSR journal of VLSI and Signal Processing, Jg. 4 (2014), S. 59-63
    Online unknown
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    Design and Analysis of Conventional and Ratioed Cmos Logic Circuit
    Verma, Akhilesh
    In: IOSR journal of VLSI and Signal Processing, Jg. 2 (2013), S. 25-29
    Online unknown
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    Low Power SAR-ADC in 0.18μm Mixed-Mode CMOS Process for Biomedical Applications
    Krishna, Suneel
    In: IOSR Journal of VLSI and Signal Processing, Jg. 3 (2013), S. 29-35
    Online unknown
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    Low voltage CMOS Schmitt Trigger in 0.18μm technology
    Siti Amaniah Mohd Chachuli ; Arith, Faiz ; et al.
    In: IOSR Journal of Engineering, 2013-03-01, S. 8-15
    Online unknown
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    Power Gating to reduce Leakage Current in Low Power CMOS Circuits
    B.P, Sharath
    In: IOSR Journal of VLSI and Signal Processing, Jg. 3 (2013), S. 19-22
    Online unknown
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    Design a Low Power High Speed Full Adder Using AVL Technique Based on CMOS Nano-Technology
    S R P Sinha ; Devendra Kumar Gautam
    In: IOSR Journal of Electronics and Communication Engineering, Jg. 8 (2013), S. 19-26
    Online unknown
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    Charge Pump, Loop Filter and VCO for Phase Lock Loop Using 0.18µm CMOS Technology
    Kashyap K. Patel Kashyap K. Patel
    In: IOSR journal of VLSI and Signal Processing, Jg. 2 (2013), S. 21-25
    Online unknown
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    Performance Analysis of CMOS and FinFET Logic
    R.Rajprabu, R.Rajprabu
    In: IOSR journal of VLSI and Signal Processing, Jg. 2 (2013), S. 1-6
    Online unknown
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    A Review of Evolution comes in Non Volatile Semiconductor memories like SONOS with the role of high k-dielectric material
    Kandpal, Khyati ; Nainwal, Renu ; et al.
    In: IOSR Journal of Engineering, Jg. 4 (2014), S. 13-17
    Online unknown
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    A Study of JK and T Flip Flops with and without Delay Using QCA
    Bal, Aditi ; Sengupta, Supriyo ; et al.
    In: IOSR Journal of VLSI and Signal Processing, Jg. 4 (2014), S. 70-76
    Online unknown
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    Comparitive analysis of power optimization using mtcmos, transistor sizing & combined technique on 180nm technology
    kshi, Kama ; Kaushik, Neelam ; et al.
    In: IOSR journal of VLSI and Signal Processing, Jg. 4 (2014), S. 16-23
    Online unknown
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  15. Detailansicht für Treffer 15 öffnen
    Performance Analysis of Energy Efficient and Charge Recovery Adiabatic Techniques for Low Power Design
    A. P India ; Yasoda, B. ; et al.
    In: IOSR Journal of Engineering, 2013-06-01, S. 14-21
    Online unknown
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  16. Detailansicht für Treffer 16 öffnen
    Design of Low Power FFT using Self-sleep Buffer with Body bias Technique
    T. Esther Rani T. Esther Rani
    In: IOSR journal of VLSI and Signal Processing, Jg. 2 (2013), S. 9-16
    Online unknown
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  17. Detailansicht für Treffer 17 öffnen
    Design and Analysis of Johnson Counter Using Finfet Technology
    Myneni Jahnavi Myneni Jahnavi
    In: IOSR journal of VLSI and Signal Processing, Jg. 1 (2013), S. 1-6
    Online unknown
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  18. Detailansicht für Treffer 18 öffnen
    Detection of Faults in SRAM Using Transient Current Testing
    Minu E Mathew ; Anumol, K
    In: IOSR journal of VLSI and Signal Processing, Jg. 2 (2013), S. 21-26
    Online unknown
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  19. Detailansicht für Treffer 19 öffnen
    Optimized Design of an Alu Block Using Power Gating Technique
    P. Ramana Reddy ; Anvesh, S.
    In: IOSR Journal of Electronics and Communication Engineering, Jg. 4 (2012), S. 24-30
    Online unknown
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  20. Detailansicht für Treffer 20 öffnen
    Performance of low power Domino Circuits using pseudo dynamic buffer
    Vimal Kant Pandey ; Kumar, Rajeev ; et al.
    In: IOSR Journal of VLSI and Signal Processing, Jg. 4 (2014), S. 62-69
    Online unknown
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