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    Thrown under the Bus: The Signaling Role of CMO Dismissal and its Effect on Firm Value.
    Alhoqail, Saad A. ; Zacca, Robert ; et al.
    In: Journal of East-West Business, Jg. 28 (2022-10-01), Heft 4, S. 388-403
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    Ultra-Low Power 0.55 mW 2.4 GHz CMOS Low-Noise Amplifier for Wireless Sensor Network.
    Zainol Murad, Sohiful Anuar ; Azizan, Anishaziela ; et al.
    In: IETE Journal of Research, Jg. 68 (2022-05-01), Heft 3, S. 2063-2068
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    A 23 dBm Gain Shaping Stacked Power Block CMOS Power Amplifier Achieving 36% PAE.
    Gunasegaran, Premmilaah ; Rajendran, Jagadheswaran ; et al.
    In: IETE Journal of Research, Jg. 69 (2023-09-01), Heft 9, S. 6247-6254
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    High linear low voltage CMOS power amplifier for 2.4 GHz applications.
    Manjula, S ; Anandan, P ; et al.
    In: International Journal of Electronics Letters, Jg. 11 (2023-09-01), Heft 3, S. 346-354
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    CMOS Analog Amplifier Circuits Design Using Seeker Optimization Algorithm.
    Maji, K. B. ; De, B. P. ; et al.
    In: IETE Journal of Research, Jg. 68 (2022-03-01), Heft 2, S. 1376-1385
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    A new low voltage low power fully differential CMOS class AB current output stage with unique current drive capability.
    Abdoli, Behnam ; Azhari, Seyed Javad
    In: International Journal of Electronics, Jg. 111 (2024-05-01), Heft 5, S. 835-857
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    Design and analysis of a high-performance 90-101 GHz CMOS power amplifier.
    Lin, Yo-Sheng ; Lan, Kai-Siang
    In: International Journal of Electronics, Jg. 109 (2022), Heft 1, S. 38-57
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    Design and Simulation of Reliable Low Power CMOS Logic Gates.
    Sharma, Vijay Kumar
    In: IETE Journal of Research, Jg. 69 (2023-02-01), Heft 2, S. 1022-1032
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    Gated Clock and Revised Keeper (GCRK) Domino Logic Design in 16 nm CMOS Technology.
    Singhal, Smita ; Mehra, Anu
    In: IETE Journal of Research, Jg. 69 (2023-03-01), Heft 3, S. 1686-1693
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    CMOS Schmitt – Inverter-Based Internal Reference Comparator Array for High Temperature Flash ADC.
    Joseph, George M. ; Shahul Hameed, T. A.
    In: IETE Journal of Research, Jg. 69 (2023-03-01), Heft 3, S. 1271-1282
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    A 5.4 ps resolution TDC design with anti-PVT-variation mechanism using 90-nm CMOS process.
    Wang, Chua-Chin ; Jose, Oliver Lexter July A. ; et al.
    In: International Journal of Electronics, Jg. 111 (2024-07-01), Heft 7, S. 1129-1142
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    A PVT tolerant latch in a 90-nm CMOS and performances under AC noise.
    Kumar, Mithilesh ; Mondal, Abir J
    In: International Journal of Electronics, Jg. 111 (2024), Heft 1, S. 86-104
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    Sensitivity of SET Pulse-Width and Propagation to Radiation Track Parameters in CMOS Inverter Chain.
    Pasupathy, K. R. ; Bindu, B.
    In: IETE Journal of Research, Jg. 68 (2022-11-01), Heft 6, S. 4120-4128
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