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    A New Pathway Toward Implementing a Fully Integrated Band-Switchable CMOS Power Amplifier Utilizing Bit Optimized Reconfigurable Network (BORN).
    Hamidi, Seyyed Babak ; Dawn, Debasis
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-09-01), Heft 9, S. 1294-1305
    Online academicJournal
    Zugriff:
    Volltext
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  2. Detailansicht für Treffer 2 öffnen
    Design of a 5.3-GHz 31.3-dBm Fully Integrated CMOS Power Amplifier Using Folded Splitting and Combining Architecture.
    Tsai, Jeng-Han
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-07-01), Heft 7, S. 1527-1536
    Online academicJournal
    Zugriff:
    Volltext
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  3. Detailansicht für Treffer 3 öffnen
    Design and analysis of an ultrawide-band distributed CMOS mixer
    Safarian, Amin Q ; Yazdi, A ; et al.
    In: IEEE TRANSACTIONS ON VERY LARGE SCALE INTEGRATION (VLSI) SYSTEMS, Jg. 13 (2005-05-01), Heft 5
    Online academicJournal
    Zugriff:
    View record in eScholarship (Volltext)
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  4. Detailansicht für Treffer 4 öffnen
    A Reconfigurable CMOS Rectifier With 14-dB Power Dynamic Range Achieving >36-dB/mm 2 FoM for RF-Based Hybrid Energy Harvesting.
    Choo, Alexander ; Ramiah, Harikrishnan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-10-01), Heft 10, S. 1533-1537
    Online academicJournal
    Zugriff:
    Volltext
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  5. Detailansicht für Treffer 5 öffnen
    Power-On Reset Circuit in 180-nm CMOS With Brownout Detection, Stable Switching Points, Long Reset Pulse Duration, and Resilience to Switching Noise.
    Antonov, Andrei A. ; Karpovich, Maksim S. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-10-01), Heft 10, S. 1373-1380
    Online academicJournal
    Zugriff:
    Volltext
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  6. Detailansicht für Treffer 6 öffnen
    ADIC: Anomaly Detection Integrated Circuit in 65-nm CMOS Utilizing Approximate Computing.
    Kar, Bapi ; Gopalakrishnan, Pradeep Kumar ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-12-01), Heft 12, S. 2518-2529
    Online academicJournal
    Zugriff:
    Volltext
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  7. Detailansicht für Treffer 7 öffnen
    Scalable Digital CMOS Comparator Using a Parallel Prefix Tree
    Abdel-Hafeez, Saleh ; Gordon-Ross, Ann ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013-11-01), Heft 11
    Online academicJournal
    Zugriff:
    View record in eScholarship (Volltext)
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  8. Detailansicht für Treffer 8 öffnen
    CMOS First-Order All-Pass Filter With 2-Hz Pole Frequency.
    Paul, Anindita ; Ramirez-Angulo, Jaime ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-02-01), Heft 2, S. 294-303
    Online academicJournal
    Zugriff:
    Volltext
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  9. Detailansicht für Treffer 9 öffnen
    A Comprehensive Time-Dependent Dielectric Breakdown Lifetime Simulator for Both Traditional CMOS and FinFET Technology.
    Yang, Kexin ; Liu, Taizhi ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-11-01), Heft 11, S. 2470-2482
    Online academicJournal
    Zugriff:
    Volltext
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  10. Detailansicht für Treffer 10 öffnen
    Design Exploration of Hybrid CMOS and Memristor Circuit by New Modified Nodal Analysis
    WEI, FEI ; HAO, YU ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 6, S. 1012-1025
    Online academicJournal
    Zugriff:
    Volltext
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  11. Detailansicht für Treffer 11 öffnen
    Body-Bias-Driven Design Strategy for Area- and Performance-Efficient CMOS Circuits
    MEIJER, Maurice ; DE GYVEZ, José Pineda
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 1, S. 42-51
    Online academicJournal
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    Volltext
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  12. Detailansicht für Treffer 12 öffnen
    A Wide-Range PLL Using Self-Healing Prescaler/VCO in 65-nm CMOS
    LEE, I-Ting ; TSAI, Yun-Ta ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 2, S. 250-258
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Low-Cost Error Tolerance Scheme for 3-D CMOS Imagers
    CHANG, Hsiu-Ming ; HUANG, Jiun-Lang ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 3, S. 465-474
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    A Statistical Design Approach for a Digitally Programmable Mismatch-Tolerant High-Speed Nauta Structure Differential OTA in 65-nm CMOS.
    Nicholson, Andrew Peter ; Iberzanov, Artemij ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-09-01), Heft 9, S. 2899-2910
    Online academicJournal
    Zugriff:
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  15. Detailansicht für Treffer 15 öffnen
    CS-CMOS: A Low-Noise Logic Family for Mixed Signal SoCs
    TAPARIA, Ajay ; BANERJEE, Bhaskar ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 12, S. 2141-2148
    Online academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    FPGA Based on Integration of CMOS and RRAM
    TANACHUTIWAT, Sansiri ; MING, LIU ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 11, S. 2023-2032
    Online academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    Design and Performance Evaluation of Radiation Hardened Latches for Nanoscale CMOS
    SHENG, LIN ; KIM, Yong-Bin ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 7, S. 1315-1319
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  18. Detailansicht für Treffer 18 öffnen
    A CMOS Image Sensor With On-Chip Image Compression Based on Predictive Boundary Adaptation and Memoryless QTD Algorithm
    SHOUSHUN, CHEN ; BERMAK, Amine ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 4, S. 538-547
    Online academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    A 0.5-V Multiple-Input Bulk-Driven OTA in 0.18-μm CMOS.
    Khateb, Fabian ; Kulej, Tomasz ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-11-01), Heft 11, S. 1739-1747
    Online academicJournal
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  20. Detailansicht für Treffer 20 öffnen
    Compressive Acquisition CMOS Image Sensor: From the Algorithm to Hardware Implementation
    MILIN, ZHANG ; BERMAK, Amine
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 18 (2010), Heft 3, S. 490-500
    Online academicJournal
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