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    An approach based on neural computation to simulate the nanoscale CMOS circuits: Application to the simulation of CMOS inverter
    DJEFFAL, F ; CHAHDI, M ; et al.
    In: Solid-state electronics, Jg. 51 (2007), Heft 1, S. 48-56
    academicJournal
    Wie komme ich dran?
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    A low-power and high-gain fully integrated CMOS LNA
    TOOFAN, S ; RAHMATI, A. R ; et al.
    In: Microelectronics journal, Jg. 38 (2007), Heft 12, S. 1150-1155
    academicJournal
    Wie komme ich dran?
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    Voltage optimization for simultaneous energy efficiency and temperature variation resilience in CMOS circuits
    KUMAR, Ranjith ; KURSUN, Volkan
    In: Microelectronics journal, Jg. 38 (2007), Heft 4-5, S. 583-594
    academicJournal
    Wie komme ich dran?
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    A p + /p-buffer/n-epi cmos compatible high-side RESURE LDMOS transistor for Power IC applications
    HOLLAND, P ; IGIC, P
    In: Microelectronics journal, Jg. 38 (2007), Heft 6-7, S. 762-766
    academicJournal
    Wie komme ich dran?
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    Lumped-element analysis and design of CMOS distributed amplifiers with image impedance termination
    MOEZ, Kambiz K ; ELMASRY, Mohamed I
    In: Microelectronics journal, Jg. 37 (2006), Heft 10, S. 1136-1145
    academicJournal
    Wie komme ich dran?
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    Impact of technology scaling and process variations on RF CMOS devices
    HASSAN, Hassan ; ANIS, Mohab ; et al.
    In: Microelectronics journal, Jg. 37 (2006), Heft 4, S. 275-282
    academicJournal
    Wie komme ich dran?
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    A high current gain gate-controlled lateral bipolar junction transistor with 90 nm CMOS technology for future RF SoC applications
    CHEN, Shuo-Mao ; FANG, Yean-Kuen ; et al.
    In: Solid-state electronics, Jg. 52 (2008), Heft 8, S. 1140-1144
    academicJournal
    Wie komme ich dran?
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    High-performance integrated inductor and effective crosstalk isolation using post-CMOS selective grown porous silicon (SGPS) technique for RFIC applications
    CHEN, LI ; HUAILIN, LIAO ; et al.
    In: Solid-state electronics, Jg. 51 (2007), Heft 6, S. 989-994
    academicJournal
    Wie komme ich dran?
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    Emulating switch-level models of CMOS circuits : On VLSI design and test
    EJLALI, Alireza ; SEYED GHASSEM, MIREMADI
    In: Microelectronic engineering, Jg. 84 (2007), Heft 2, S. 204-212
    academicJournal
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    CMOS RF class-D power amplifier with bandpass sigma-delta modulation
    JOHNSON, Thomas ; SOBOT, Robert ; et al.
    In: Microelectronics journal, Jg. 38 (2007), Heft 3, S. 439-446
    academicJournal
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    Design and modelling of a multi-standard fractional PLL in CMOS/SOI technology
    JACQUEMOD, Gilles ; GEYNET, Lionel ; et al.
    In: Microelectronics journal, Jg. 39 (2008), Heft 9, S. 1130-1139
    academicJournal
    Wie komme ich dran?
  12. Detailansicht für Treffer 12 öffnen
    Optimization of a very cost-effective high voltage p-channel transistor implemented in a standard twin-tub CMOS technology
    PEREZ-TOMAS, A ; JORDA, X ; et al.
    In: Microelectronic engineering, Jg. 77 (2005), Heft 2, S. 158-167
    academicJournal
    Wie komme ich dran?
  13. Detailansicht für Treffer 13 öffnen
    Nanoscale CMOS: potential nonclassical technologies versus a hypothetical bulk-silicon technology
    KIM, Seung-Hwan ; FOSSUM, Jerry G
    In: Solid-state electronics, Jg. 49 (2005), Heft 4, S. 595-605
    academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    Fault detection in CMOS/SOI mixed-signal circuits using the quiescent current test
    DE VENUTO, D ; KAYAL, M ; et al.
    In: Microelectronics journal, Jg. 33 (2002), Heft 5-6, S. 387-397
    academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    An automatic parameter extraction technique for advanced CMOS device modeling using genetic algorithm : On VLSI design and test
    YIMING, LI
    In: Microelectronic engineering, Jg. 84 (2007), Heft 2, S. 260-272
    academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    A single-poly EEPROM cell structure compatible to standard CMOS process
    LIN, Ching-Fang ; SUN, Cherng-Yuan
    In: Solid-state electronics, Jg. 51 (2007), Heft 6, S. 888-893
    academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    IGBT gate driver IC with full-bridge output stage using a modified standard CMOS process
    PEREZ-TOMAS, A ; JORDA, X ; et al.
    In: Microelectronics journal, Jg. 35 (2004), Heft 8, S. 659-666
    academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    High-voltage NMOS design in fully implanted twin-well CMOS
    SANTOS, P. M ; QUARESMA, H ; et al.
    In: Microelectronics journal, Jg. 35 (2004), Heft 9, S. 723-730
    academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    Design of single-gate n-channel and p-channel MOSFETs with enhanced current-drive due to simultaneous switching of front and back channels in SOI CMOS technology
    BINDU, B ; LAKSHMI, N ; et al.
    In: Solid-state electronics, Jg. 50 (2006), Heft 7-8, S. 1359-1367
    academicJournal
    Wie komme ich dran?
  20. Detailansicht für Treffer 20 öffnen
    Aslic : A low power CMOS analog circuit design automation
    LEE, Jihyun ; KIM, Yong-Bin
    In: Integration (Amsterdam), Jg. 39 (2006), Heft 3, S. 157-181
    academicJournal
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