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    Low‐power column counter with a logical‐shift algorithm for CMOS image sensors
    Soo Youn Kim ; Park, K.
    In: Electronics Letters, Jg. 56 (2020-03-01), S. 232-234
    Online unknown
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    Low‐power high‐performance CMOS 5‐2 compressor with 58 transistors
    Konofaos, Nikolaos ; Balobas, Dimitrios
    In: Electronics Letters, Jg. 54 (2018-03-01), S. 278-280
    Online unknown
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    Low power‐delay‐product dynamic CMOS circuit design techniques
    Xue, H. ; Ren, S.
    In: Electronics Letters, Jg. 53 (2017-03-01), S. 302-304
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  4. Detailansicht für Treffer 4 öffnen
    Capacitor mismatch calibration method for SAR ADC with minimum area and power penalty
    Zhao, Menglian ; Yang, Xiaolin ; et al.
    In: Electronics Letters, Jg. 54 (2018-10-01), S. 1208-1210
    Online unknown
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    Limit‐cycle oscillation reduction in high‐efficiency wireless power receiver
    Zeng, Jianxu ; Zheng, Yanqi ; et al.
    In: Electronics Letters, Jg. 53 (2017-08-01), S. 1152-1154
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  6. Detailansicht für Treffer 6 öffnen
    Power optimisation of both a high‐speed counter and a retiming element for 2.4 GHz digital PLLs
    Silva-Pereira, Marco ; J. Caldinhas Vaz
    In: Electronics Letters, Jg. 54 (2018-03-01), S. 284-285
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  7. Detailansicht für Treffer 7 öffnen
    Diode triggered ESD power clamp circuit with accurate discharge duration
    Yang, Yuan ; Yu, Ningmei ; et al.
    In: Electronics Letters, Jg. 52 (2016-05-01), S. 949-950
    Online unknown
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  8. Detailansicht für Treffer 8 öffnen
    4.2 GHz 0.81 mW triple‐modulus prescaler based on true single‐phase clock
    Yu, Fengqi ; Jiang, Wenjian
    In: Electronics Letters, Jg. 52 (2016-06-01), S. 1007-1008
    Online unknown
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  9. Detailansicht für Treffer 9 öffnen
    Power‐efficient flash ADC with complementary voltage‐to‐time converter
    Roh, Y.-J. ; Jo, D.-S. ; et al.
    In: Electronics Letters, Jg. 53 (2017-06-01), S. 772-773
    Online unknown
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