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    A compact four quadrant CMOS analog multiplier
    Ramirez-Angulo, Jaime ; Jose Miguel Rocha-Perez ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 108 (2019-08-01), S. 53-61
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    Novel CMOS multi-bit counter for speed-power optimization in multiplier design
    Pal, Rahul ; Aloke Kumar Saha ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 95 (2018-10-01), S. 189-198
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    Low power DDA-based instrumentation amplifier for neural recording applications in 65 nm CMOS
    Monsurro, Pietro ; Trifiletti, Alessandro ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 92 (2018-08-01), S. 30-35
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    A novel 0.84 ppm/°C CMOS curvature-compensated bandgap with 1.2 V supply voltage
    Yan, Xiaobing ; Xu, Huachao ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 91 (2018-07-01), S. 66-74
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    All-digital clock and data recovery circuit for USB applications in 65 nm CMOS technology
    Salem, Sanaz ; Saneei, Mohsen
    In: AEU - International Journal of Electronics and Communications, Jg. 103 (2019-05-01), S. 1-12
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    Bulk-driven fully balanced second-generation current conveyor in 0.18 µm CMOS
    Khateb, Fabian ; Kumngern, Montree ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 104 (2019-05-01), S. 66-75
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    A new approach for 10-bit pipeline analog-to-digital converter design based on 0.18 µm CMOS technology
    Rezapour, Arash ; Mohammad Bagher Tavakoli ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 99 (2019-02-01), S. 299-314
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    A 28 GHz four-channel phased-array transceiver in 65-nm CMOS technology for 5G applications
    El-Gamal, Mohamed ; Zakaria, Yahia ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 98 (2019), S. 19-28
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    DPL-based novel Binary-to-ternary converter on CMOS technology
    Pal, Dipankar ; Aloke Kumar Saha
    In: AEU - International Journal of Electronics and Communications, Jg. 92 (2018-08-01), S. 69-73
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    A 5-bit 1.8 GS/s ADC-based receiver with two-tap low-overhead embedded DFE in 130-nm CMOS
    Dousti, Massoud ; Mahmoudi, Azad ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 89 (2018-05-01), S. 6-14
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    Low-voltage subthreshold CMOS current mode circuits: Design and applications
    Ismail, Yehea ; El-Ghitani, Hassan ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 82 (2017-12-01), S. 251-264
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    A novel adaptive real-time detection algorithm for an area-efficient CMOS spike detector circuit
    Dwivedi, Shashank ; Anup Kumar Gogoi
    In: AEU - International Journal of Electronics and Communications, Jg. 88 (2018-05-01), S. 87-97
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    A 5.7–6.0 GHz CMOS PLL with low phase noise and −68 dBc reference spur
    Wang, Wenshen ; Liu, Huimin ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 85 (2018-02-01), S. 23-31
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    A 50–82 GHz broadband cascode-based power amplifier in 40 nm CMOS
    Pan, Quan ; Xiao, Wenbo ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 137 (2021-07-01), S. 153824-153824
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    A high performance differential input CMOS current buffer
    Arslan, Emre
    In: AEU - International Journal of Electronics and Communications, Jg. 82 (2017-12-01), S. 1-6
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    The design and analysis of dual control voltages delay cell for low power and wide tuning range ring oscillators in 65 nm CMOS technology for CDR applications
    Tajabadi, Mehrnaz ; Saneei, Mohsen ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 82 (2017-12-01), S. 406-412
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    A CMOS current mode four quadrant analog multiplier free from mobility reduction
    Besbes, Kamel ; Aloui, Imen ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 82 (2017-12-01), S. 119-126
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    Sub 0.5-V bulk-driven LTA in 0.18 μm CMOS
    Khateb, Fabian ; Kulej, Tomasz
    In: AEU - International Journal of Electronics and Communications, Jg. 77 (2017-07-01), S. 67-75
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    CMOS realization of electronically tunable VDCC based single-input-dual-output filter
    Kaçar, Fırat ; Kuntman, Hakan ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 132 (2021-04-01), S. 153627-153627
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    A 0.75 V Sub-mW CMOS LNA employing transmitted signal suppression technique in a full-duplex wireless brain-machine interface transceiver
    Dousti, Massoud ; Ghalamkari, Behbod ; et al.
    In: AEU - International Journal of Electronics and Communications, Jg. 132 (2021-04-01), S. 153632-153632
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