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    Configurable Logic Operations Using Hybrid CRS-CMOS Cells
    Shuai, Li ; Wang, Xiaoping ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-12-01), S. 2641-2647
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    A 13.56-MHz CMOS Active Rectifier With a Voltage Mode Switched-Offset Comparator for Implantable Medical Devices
    Sanchez-Sinencio, Edgar ; Zhang, Minglei ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-10-01), S. 2050-2060
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    A Multi-Gb/s Frame-Interleaved LDPC Decoder With Path-Unrolled Message Passing in 28-nm CMOS
    P. Glenn Gulak ; Milicevic, Mario
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-10-01), S. 1908-1921
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    Neuromorphic Vision Hybrid RRAM-CMOS Architecture
    Cho, Kyoung-Rok ; Herbert Ho-Ching Iu ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-12-01), S. 2816-2829
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    A 0.9-V 12-bit 100-MS/s 14.6-fJ/Conversion-Step SAR ADC in 40-nm CMOS
    Li, Jing ; Liu, Yang ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-10-01), S. 1980-1988
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    A Low-Power Forward and Reverse Body Bias Generator in CMOS 40 nm
    Wu, Chundong ; Wang, Lei ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-07-01), S. 1403-1407
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    Input Offset Estimation of CMOS Integrated Circuits in Weak Inversion
    Moradi, Farshad ; Hashemipour, Omid ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-09-01), S. 1812-1816
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    A 5-to-8-GHz Wideband Miniaturized Dielectric Spectroscopy Chip With <tex-math notation='LaTeX'>$I/Q$ </tex-math> Mismatch Calibration in 65-nm CMOS
    Ma, Shunli ; Li, Ning ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-08-01), S. 1554-1564
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    An Electrical Model for Nanometer CMOS Device Stress Effect in Design and Simulation of Analog Reference Circuits
    Wang, Dong ; Pak Kwong Chan
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-05-01), S. 958-968
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    An Interference-Robust Reconfigurable Receiver With Automatic Frequency-Calibrated LNA in 65-nm CMOS
    Chi, Baoyong ; Hao, Jiachen ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-11-01), S. 3113-3124
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    A Dynamic Leakage and Slew Rate Compensation Circuit for 40-nm CMOS Mixed-Voltage Output Buffer
    Lee, Tzung-Je ; Lin, Wei ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-11-01), S. 3166-3174
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    A Continuous-Time MASH 1-1-1 Delta–Sigma Modulator With FIR DAC and Encoder-Embedded Loop-Unrolling Quantizer in 40-nm CMOS
    Edward, Alexander ; Zhou, Dadian ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-04-01), S. 756-767
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    Zero-Power Feed-Forward Spur Cancelation for Supply-Regulated CMOS Ring PLLs
    Heo, Deukhyoun ; Partha Pratim Pande ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-04-01), S. 653-662
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    A 16-mW 1-GS/s With 49.6-dB SNDR TI-SAR ADC for Software-Defined Radio in 65-nm CMOS
    Tang, Kai ; Zhu, Yan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-03-01), S. 572-583
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    Resource-Efficient Object-Recognition Coprocessor With Parallel Processing of Multiple Scan Windows in 65-nm CMOS
    Hans Jurgen Mattausch ; Luo, Aiwen ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-03-01), S. 431-444
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    A Process-Independent and Highly Linear DCO for Crowded Heterogeneous IoT Devices in 65-nm CMOS
    Mohammad Bagher Ghaznavi-Ghoushchi ; Gorji, J.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-12-01), S. 3369-3379
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    A 20-nW 0.25-V Inverter-Based Asynchronous Delta–Sigma Modulator in 130-nm Digital CMOS Process
    Ferreira, Luis H. C. ; Giseli Valentim Rocha ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-12-01), S. 3455-3463
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    An 11-bit 100-MS/s Subranged-SAR ADC in 65-nm CMOS
    Yen, Chia-Wei ; Chung, Yung-Hui
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-12-01), S. 3434-3443
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    A 7.1-mW $K/K_{a}$ -Band Mixer With Configurable Bondwire Resonators in 65-nm CMOS
    Kuo, Ming-Ching ; Ko, Chun-Lin ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-09-01), S. 2635-2648
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    A Closed-Form Expression for Minimum Operating Voltage of CMOS D Flip-Flop
    O'uchi, Shin-ichi ; Matsukawa, Takashi ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-07-01), S. 2007-2016
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