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    A 1 mW 71.5 dB SNDR 50 MS/s 13 bit Fully Differential Ring Amplifier Based SAR-Assisted Pipeline ADC.
    Lim, Yong ; Flynn, Michael P.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-12-01), Heft 12, S. 2901-2911
    Online academicJournal
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    A Calibration-Free 14-b 0.7-mW 100-MS/s Pipelined-SAR ADC Using a Weighted- Averaging Correlated Level Shifting Technique.
    Wang, Jia-Ching ; Hung, Tsung-Chih ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-12-01), Heft 12, S. 3271-3280
    Online academicJournal
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    A 14 Bit 1 GS/s RF Sampling Pipelined ADC With Background Calibration.
    Ali, Ahmed M. A. ; Dinc, Huseyin ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 2857-2867
    Online academicJournal
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    Volltext
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    A 1.5 mW 68 dB SNDR 80 Ms/s 2\times Interleaved Pipelined SAR ADC in 28 nm CMOS.
    van der Goes, Frank ; Ward, Christopher M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 2835-2845
    Online academicJournal
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    Precision Passive-Charge-Sharing SAR ADC: Analysis, Design, and Measurement Results.
    Chen, Baozhen ; Maddox, Mark ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-05-01), Heft 5, S. 1481-1492
    Online academicJournal
    Zugriff:
    Volltext
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    A 69-dB SNDR 300-MS/s Two-Time Interleaved Pipelined SAR ADC in 16-nm CMOS FinFET With Capacitive Reference Stabilization.
    Martens, Ewout ; Hershberg, Benjamin ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-04-01), Heft 4, S. 1161-1171
    Online academicJournal
    Zugriff:
    Volltext
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    A 150 kHz–80 MHz BW Discrete-Time Analog Baseband for Software-Defined-Radio Receivers using a 5th-Order IIR LPF, Active FIR and a 10 bit 300 MS/s ADC in 28 nm CMOS.
    Malki, Badr ; Verbruggen, Bob ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-07-01), Heft 7, S. 1593-1606
    Online academicJournal
    Zugriff:
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    A 100 MS/s, 10.5 Bit, 2.46 mW Comparator-Less Pipeline ADC Using Self-Biased Ring Amplifiers.
    Lim, Yong ; Flynn, Michael P.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-10-01), Heft 10, S. 2331-2341
    Online academicJournal
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    A SAR ADC With a MOSCAP-DAC.
    Rabuske, Taimur ; Fernandes, Jorge
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-06-01), Heft 6, S. 1410-1422
    Online academicJournal
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  10. Detailansicht für Treffer 10 öffnen
    A 1 GS/s 10b 18.9 mW Time-Interleaved SAR ADC With Background Timing Skew Calibration.
    Lee, Sunghyuk ; Chandrakasan, Anantha P. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 2846-2856
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    A 4.2 mW 50 MS/s 13 bit CMOS SAR ADC With SNR and SFDR Enhancement Techniques.
    Miki, Takuji ; Morie, Takashi ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-06-01), Heft 6, S. 1372-1381
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    A 10b/12b 40 kS/s SAR ADC With Data-Driven Noise Reduction Achieving up to 10.1b ENOB at 2.2 fJ/Conversion-Step.
    Harpe, Pieter ; Cantatore, Eugenio ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-12-01), Heft 12, S. 3011-3018
    Online academicJournal
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    A 3.1 mW 8b 1.2 GS/s Single-Channel Asynchronous SAR ADC With Alternate Comparators for Enhanced Speed in 32 nm Digital SOI CMOS.
    Kull, Lukas ; Toifl, Thomas ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-12-01), Heft 12, S. 3049-3058
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    A 14b 80 MS/s SAR ADC With 73.6 dB SNDR in 65 nm CMOS.
    Kapusta, Ron ; Shen, Junhua ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-12-01), Heft 12, S. 3059-3066
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    A 2.8 GS/s 44.6 mW Time-Interleaved ADC Achieving 50.9 dB SNDR and 3 dB Effective Resolution Bandwidth of 1.5 GHz in 65 nm CMOS.
    Stepanovic, Dušan ; Nikolic, Borivoje
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-04-01), Heft 4, S. 971-982
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    A 53-nW 9.1-ENOB 1-kS/s SAR ADC in 0.13-\mum CMOS for Medical Implant Devices.
    Zhang, Dai ; Bhide, Ameya ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-07-01), Heft 7, S. 1585-1593
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    A 0.5 V 1.1 MS/sec 6.3 fJ/Conversion-Step SAR-ADC With Tri-Level Comparator in 40 nm CMOS.
    Shikata, Akira ; Sekimoto, Ryota ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-04-01), Heft 4, S. 1022-1030
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    A 0.47–1.6 mW 5-bit 0.5–1 GS/s Time-Interleaved SAR ADC for Low-Power UWB Radios.
    Harpe, Pieter J. A. ; Busze, Ben ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-07-01), Heft 7, S. 1594-1602
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    A 26 \muW 8 bit 10 MS/s Asynchronous SAR ADC for Low Energy Radios.
    Harpe, Pieter J. A. ; Zhou, Cui ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011-06-01), Heft 7, S. 1585-1595
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    An 18 b 12.5 MS/s ADC With 93 dB SNR.
    Hurrell, Christopher Peter ; Lyden, Colin ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010-12-01), Heft 12, S. 2647-2654
    Online academicJournal
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