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    A Novel MTCMOS Stacking Approach to Reduce Mode Transition Energy and Leakage Current in CMOS Full Adder Circuit
    Singh, Sangeeta ; Kumar, Anjan
    2020
    Online unknown
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    Wie komme ich dran?
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    Comparative Analysis of Adder for Various CMOS Technologies
    Peeyush, Garg ; M Amrith Vishnu ; et al.
    2020
    Online unknown
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    Wie komme ich dran?
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    Design of a 4-Bit Wallace Tree Encoder for Flash ADC in 90 Nm CMOS Technology
    Sanjay Kumar Surshetty ; Datta, Krishna ; et al.
    2020
    Online unknown
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    Wie komme ich dran?
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    Design of Nanoscale TIEO-Based Arithmetic Circuits Using QCA Implementation Paradigm
    Manju, S. ; Jagadeeswari, M. ; et al.
    2021
    Online unknown
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    Wie komme ich dran?
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    Implementation and Analysis of Low Power Consumption Full Swing GDI Full Adders
    Shete, Deepgandha ; Askhedkar, Anuja
    2021
    Online unknown
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    Wie komme ich dran?
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    Design and Characterization of a Multilayer Reversible 'Carry Look-Ahead Adder' by Using QCA Spin Technique
    Sarkar, Swarup ; Roy, Rupsa ; et al.
    2021
    Online unknown
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    Wie komme ich dran?
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    Adiabatic Logic-Based Area- and Energy-Efficient Full Adder Design
    B. Leela Kumari ; Saladi, Krishna
    2021
    Online unknown
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    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    A Cost-Efficient QCA XOR Function Based Arithmetic Logic Unit for Nanotechnology Applications
    Tripathi, Divya ; Wairya, Subodh
    2021
    Online unknown
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    Wie komme ich dran?
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    Physical Design and Implementation of Multibit Multilayer 3D Reversible Ripple Carry Adder Using 'QCA-ES' Nanotechnique
    Sarkar, Swarup ; Roy, Rupsa ; et al.
    2021
    Online unknown
    Zugriff:
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    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    Design and Performance Evaluation of Highly Efficient Adders in Nanometer Technology
    Wairya, Subodh ; Khan, Anam ; et al.
    2020
    Online unknown
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    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    Design of Low Power Reduced Complexity Wallace Tree Multiplier Using Positive Feedback Adiabatic Logic
    Ganavi, M. G. ; Premananda, B. S.
    2020
    Online unknown
    Zugriff:
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    Wie komme ich dran?
  12. Detailansicht für Treffer 12 öffnen
    Impact of Temperature on Circuit Metrics of Various Full Adders
    M. Aalelai Vendhan
    2020
    Online unknown
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    Wie komme ich dran?
  13. Detailansicht für Treffer 13 öffnen
    Adiabatic Design Implementation of Digital Circuits for Low Power Applications
    Mani, Bhavika ; Gupta, Shaloo ; et al.
    2020
    Online unknown
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  14. Detailansicht für Treffer 14 öffnen
    Low Power Adder Circuits Using Various Leakage Reduction Techniques
    Singh, Neha ; Birla, Shilpi ; et al.
    2019
    Online unknown
    Zugriff:
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    Wie komme ich dran?
  15. Detailansicht für Treffer 15 öffnen
    Low-Power Analysis of Full Adder and Subtractor Design Using Adiabatic Logic Styles
    Rajan, Niju ; Akshitha
    2019
    Online unknown
    Zugriff:
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    Wie komme ich dran?
  16. Detailansicht für Treffer 16 öffnen
    Area and Power Efficient 2 Bit Multiplier by Using Enhanced Half Adder
    Bharti, Manisha ; Kamboj, Akshay ; et al.
    2020
    Online unknown
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    Wie komme ich dran?
  17. Detailansicht für Treffer 17 öffnen
    High-Performance Digital Logic Circuit Realization Using Differential Cascode Voltage Switch Logic (DCVSL)
    Kavitha, S. S. ; Kaulgud, Narasimha
    2020
    Online unknown
    Zugriff:
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    Wie komme ich dran?
  18. Detailansicht für Treffer 18 öffnen
    Design of Low-Power Square Root Carry Select Adder and Wallace Tree Multiplier Using Adiabatic Logic
    Premananda, B. S. ; Ganavi, M. G.
    2019
    Online unknown
    Zugriff:
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    Wie komme ich dran?
  19. Detailansicht für Treffer 19 öffnen
    Area Efficient Multilayer Designs of XOR Gate Using Quantum Dot Cellular Automata
    Singh, Rupali ; Devendra Kumar Sharma
    2020
    Online unknown
    Zugriff:
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    Wie komme ich dran?
  20. Detailansicht für Treffer 20 öffnen
    Design of a Low Power Full Adder with a Two Transistor EX-OR Gate Using Gate Diffusion Input of 90 nm
    G. Karthik Reddy ; V. Padmanabha Reddy ; et al.
    2018
    Online unknown
    Zugriff:
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    Wie komme ich dran?
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