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    Structural methods for the synthesis of speed-independent circuits
    PASTOR, E ; CORTADELLA, J ; et al.
    In: IEEE transactions on computer-aided design of integrated circuits and systems, Jg. 17 (1998), Heft 11, S. 1108-1129
    Online academicJournal
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    A region-based theory for state assignment in speed-independent circuits
    CORTADELLA, J ; KISHINEVSKY, M ; et al.
    In: IEEE transactions on computer-aided design of integrated circuits and systems, Jg. 16 (1997), Heft 8, S. 793-812
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Synthesis of hazard-free asynchronous circuits with bounded wire delays
    LAVAGNO, L ; KEUTZER, K ; et al.
    In: IEEE transactions on computer-aided design of integrated circuits and systems, Jg. 14 (1995), Heft 1, S. 61-86
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Asynchronous circuit synthesis with Boolean satisfiability
    GU, J ; PURI, R
    In: IEEE transactions on computer-aided design of integrated circuits and systems, Jg. 14 (1995), Heft 8, S. 961-973
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  5. Detailansicht für Treffer 5 öffnen
    An efficient heuristic procedure for solving the state assignment problem for event-based specifications
    LAVAGNO, L ; MOON, C. W ; et al.
    In: IEEE transactions on computer-aided design of integrated circuits and systems, Jg. 14 (1995), Heft 1, S. 45-60
    Online academicJournal
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  6. Detailansicht für Treffer 6 öffnen
    Delay-fault test generation and synthesis for testability under a standard scan design methodology
    KWANG-TING, CHENG ; SRINIVAS, DEVADAS ; et al.
    In: IEEE transactions on computer-aided design of integrated circuits and systems, Jg. 12 (1993), Heft 8, S. 1217-1231
    Online academicJournal
    Zugriff:
    Volltext
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  7. Detailansicht für Treffer 7 öffnen
    Sequential test generation and synthesis for testability at the register-transfer and logic levels
    ABHIJIT, GHOSH ; SRINIVAS, DEVADAS ; et al.
    In: IEEE transactions on computer-aided design of integrated circuits and systems, Jg. 12 (1993), Heft 5, S. 579-598
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    Optimized synthesis of asynchronous control circuits from graph-theoretic specifications
    VANBEKBERGEN, P ; GOOSSENS, G ; et al.
    In: IEEE transactions on computer-aided design of integrated circuits and systems, Jg. 11 (1992), Heft 11, S. 1426-1438
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
xs 0 - 576
sm 576 - 768
md 768 - 992
lg 992 - 1200
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