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    FPGA Based Architecture of Elliptic Curve Scalar Multiplication for IOT
    Venugopal, Ellappan ; Hailu, Tadesse
    In: 2018 Conference on Emerging Devices and Smart Systems (ICEDSS), 2018-03-01, S. 178-182
    Konferenz
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    Master-Slave TMR Inspired Technique for Fault Tolerance of SRAM-Based FPGA
    Lahrach, Farid ; Doumar, Abderrahim ; et al.
    In: 2010 IEEE Computer Society Annual Symposium on VLSI, 2010-07-01, S. 58-62
    Konferenz
    Wie komme ich dran?
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    Two-phase multiobjective genetic algorithm for constrained circuit clustering on FPGAs
    Wang, Yuan ; Walker, James Alfred ; et al.
    In: 2015 IEEE Congress on Evolutionary Computation (CEC), 2015-05-01, S. 1183-1190
    Online Konferenz
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Module diversification: Fault tolerance and aging mitigation for runtime reconfigurable architectures
    Zhang, Hongyan ; Bauer, Lars ; et al.
    In: 2013 IEEE International Test Conference (ITC), 2013-09-01, S. 1-10
    Konferenz
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    A novel SRAM-based FPGA architecture for defect and fault tolerance of configurable logic blocks
    Lahrach, Farid ; Abdaoui, Abderrazek ; et al.
    In: 13th IEEE Symposium on Design and Diagnostics of Electronic Circuits and Systems, 2010-04-01, S. 305-308
    Konferenz
    Wie komme ich dran?
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    Design and implementation of FPGA based wavepipelined fast convolver
    Lakshminarayanan, G. ; Venkataramani, B. ; et al.
    In: 2000 TENCON Proceedings. Intelligent Systems and Technologies for the New Millennium (Cat. No.00CH37119), Jg. 3 (2000), S. 212-217
    Konferenz
    Wie komme ich dran?
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    FPGA Implementation of Q-RTS for Real-Time Swarm Intelligence Systems
    Cardarilli, Gian Carlo ; Di Nunzio, Luca ; et al.
    In: 2020 54th Asilomar Conference on Signals, Systems, and Computers, 2020-11-01, S. 116-120
    Konferenz
    Wie komme ich dran?
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    An Efficient Design of Anderson PUF by Utilization of the Xilinx Primitives in the SLICEM
    Lotfy, A. ; Kaveh, M. ; et al.
    In: IEEE Access, Jg. 9 (2021), S. 23025-23034
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    FPGA as a Hardware Accelerator for Computation Intensive Maximum Likelihood Expectation Maximization Medical Image Reconstruction Algorithm
    Ravi, M. ; Sewa, A. ; et al.
    In: IEEE Access, Jg. 7 (2019), S. 111727-111735
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    XOR gate based low-cost configurable RO PUF
    Zhang, Lei ; Wang, Chenghua ; et al.
    In: 2017 IEEE International Symposium on Circuits and Systems (ISCAS), 2017-05-01, S. 1-4
    Konferenz
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  11. Detailansicht für Treffer 11 öffnen
    An online task placement algorithm using Hilbert curve for a partially reconfigurable field programmable gate array
    Joseph, Senoj ; Baskaran, K.
    In: TENCON 2015 - 2015 IEEE Region 10 Conference, 2015-11-01, S. 1-6
    Konferenz
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  12. Detailansicht für Treffer 12 öffnen
    Analyzing the performance of a configurable ROPUF design controlled by programmable XOR gates
    Amsaad, Fathi ; Hoque, Tamzidul ; et al.
    In: 2015 IEEE 58th International Midwest Symposium on Circuits and Systems (MWSCAS), 2015-08-01, S. 1-4
    Konferenz
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  13. Detailansicht für Treffer 13 öffnen
    Implementation of NOR Logic Based on Material Implication on CMOL FPGA Architecture
    Mane, Pravin ; Talati, Nishil ; et al.
    In: 2015 28th International Conference on VLSI Design, 2015, S. 523-528
    Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    Development of a Field programmable GATE array based computer to controller area network store and forward buffer
    Jayarathne, D. G. N. ; Jayananda, M. K.
    In: 7th International Conference on Information and Automation for Sustainability, 2014-12-01, S. 1-6
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    Circuit Level Modeling of Extra Combinational Delays in SRAM-Based FPGAs Due to Transient Ionizing Radiation
    Darvishi, M. ; Audet, Y. ; et al.
    In: IEEE Transactions on Nuclear Science, Jg. 61 (2014-12-01), Heft 6, S. 3535-3542
    Online academicJournal
    Zugriff:
    Volltext
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  16. Detailansicht für Treffer 16 öffnen
    Multiple SEU tolerance in LUTs of FPGAs using protected schemes
    Argyrides, Costas ; Zarandi, Hamid ; et al.
    In: 2008 European Conference on Radiation and Its Effects on Components and Systems, 2008-09-01, S. 325-330
    Online Konferenz
    Zugriff:
    Full Text Finder (Volltext)
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    A new partitioning method for LUT-based FPGAS
    Ko, Seok-Bum
    In: CCECE 2003 - Canadian Conference on Electrical and Computer Engineering. Toward a Caring and Humane Technology (Cat. No.03CH37436), Jg. 1 (2003), S. 103-106
    Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    Efficient pre-processing algorithms for an FPGA based in-camera video-stream processing system for industry inspection
    Hajimowlana, S.H. ; Jullien, G.A. ; et al.
    In: CCECE '97. Canadian Conference on Electrical and Computer Engineering. Engineering Innovation: Voyage of Discovery. Conference Proceedings, Jg. 2 (1997), S. 835-838
    Konferenz
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  19. Detailansicht für Treffer 19 öffnen
    Hardware Implementation of the Salsa20 and Phelix Stream Ciphers
    Yan, Junjie ; Heys, Howard M.
    In: 2007 Canadian Conference on Electrical and Computer Engineering, 2007-04-01, S. 1125
    Konferenz
    Wie komme ich dran?
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