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    Memory streaming acceleration for embedded systems with CPU-accelerator cooperative data processing
    Lee, Kwangho ; Kong, Joonho ; et al.
    In: Microprocessors and Microsystems, Jg. 71 (2019-11-01), S. 102897-102897
    Online unknown
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    Applying frame layout to hardware design in FPGA for seamless support of cross calls in CPU-FPGA coupling architecture
    Giang Nguyen Thi Huong ; Na, Yeoul ; et al.
    In: Microprocessors and Microsystems, Jg. 35 (2011-07-01), S. 462-472
    Online unknown
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    Hardware switch for DMA transfer to augment CPU efficiency
    Elkateeb, Ali
    In: Microprocessors and Microsystems, Jg. 7 (1983-04-01), S. 117-120
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    Side-channel leakage models for RISC instruction set architectures from empirical data
    Rass, Stefan ; Seuschek, Hermann
    In: Microprocessors and Microsystems, Jg. 47 (2016-11-01), S. 74-81
    Online unknown
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    A clock synchronization method for EtherCAT master
    Chen, Xin ; Zhou, Nan ; et al.
    In: Microprocessors and Microsystems, Jg. 46 (2016-10-01), S. 211-218
    Online unknown
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    Automatic cache partitioning method for high-level synthesis
    Jones, Bryant ; Hanna, Darrin M.
    In: Microprocessors and Microsystems, Jg. 67 (2019-06-01), S. 71-81
    Online unknown
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    Cache timing attacks on NoC-based MPSoCs
    Forlin, Bruno ; Reinbrecht, Cezar ; et al.
    In: Microprocessors and Microsystems, Jg. 66 (2019-04-01), S. 1-9
    Online unknown
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    High speed FPGA-based data acquisition system
    Aboli Audumbar Khedkar ; Khade, R. H.
    In: Microprocessors and Microsystems, Jg. 49 (2017-03-01), S. 87-94
    Online unknown
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    Reusable generic design patterns for mixed-criticality systems based on DREAMS
    Larrucea, Asier ; Perez, Jon ; et al.
    In: Microprocessors and Microsystems, Jg. 54 (2017-10-01), S. 35-46
    Online unknown
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  10. Detailansicht für Treffer 10 öffnen
    Implementation of efficient SR-Latch PUF on FPGA and SoC devices
    Habib, Bilal ; Kaps, Jens-Peter ; et al.
    In: Microprocessors and Microsystems, Jg. 53 (2017-08-01), S. 92-105
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  11. Detailansicht für Treffer 11 öffnen
    Performance linked dynamic cache tuning: A static energy reduction approach in tiled CMPs
    Kapoor, Hemangee K. ; Chakraborty, Shounak
    In: Microprocessors and Microsystems, Jg. 52 (2017-07-01), S. 221-235
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  12. Detailansicht für Treffer 12 öffnen
    DAMHSE: Programming heterogeneous MPSoCs with hardware acceleration using dataflow-based design space exploration and automated rapid prototyping
    Rodriguez, Alfonso ; Eduardo de la Torre ; et al.
    In: Microprocessors and Microsystems, Jg. 71 (2019-11-01), S. 102882-102882
    Online unknown
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  13. Detailansicht für Treffer 13 öffnen
    Towards refresh-optimized EDRAM-based caches with a selective fine-grain round-robin refresh scheme
    Gong, Young-Ho ; Sung Woo Chung ; et al.
    In: Microprocessors and Microsystems, Jg. 49 (2017-03-01), S. 95-104
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  14. Detailansicht für Treffer 14 öffnen
    Rapid Transient Fault Insertion in Large Digital Systems
    Kerkhoff, Hans G. ; Rohani, Alireza
    In: Microprocessors and microsystems, Jg. 37 (2013-03-01), Heft 2, S. 147-154
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    Processor design based on dataflow concurrency
    Ziavras, Sotirios G.
    In: Microprocessors and Microsystems, Jg. 27 (2003-05-01), S. 199-220
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  16. Detailansicht für Treffer 16 öffnen
    Exploration of temperature-aware refresh schemes for 3D stacked eDRAM caches
    Sung Kyu Lim ; Gong, Young-Ho ; et al.
    In: Microprocessors and Microsystems, Jg. 42 (2016-05-01), S. 100-112
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  17. Detailansicht für Treffer 17 öffnen
    Architecture and data migration methodology for L1 cache design with hybrid SRAM and volatile STT-RAM configuration
    Shen, Po-Yuan ; Cheng, Wei-Kai ; et al.
    In: Microprocessors and Microsystems, Jg. 42 (2016-05-01), S. 191-199
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  18. Detailansicht für Treffer 18 öffnen
    Reconfigurable cache for real-time MPSoCs: Scheduling and implementation
    Chen, Gang ; Huang, Kai ; et al.
    In: Microprocessors and Microsystems, Jg. 42 (2016-05-01), S. 200-214
    Online unknown
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  19. Detailansicht für Treffer 19 öffnen
    Design and evaluation of compact ISA extensions
    Bruno Cardoso Lopes ; Xavier, Eduardo C. ; et al.
    In: Microprocessors and Microsystems, Jg. 40 (2016-02-01), S. 1-15
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    System-level integrated power management for handheld systems
    Min, Jung-Hi ; Cha, Hojung ; et al.
    In: Microprocessors and Microsystems, Jg. 33 (2009-05-01), S. 201-210
    Online unknown
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